목차
■ 실험 내용
■ 실험 방법
■ 주의사항
(1) 상태도
(2) 상태표
(3) 설계과장(플립플롬 입력식 (간략화))
(4) 설계도 ( 회로도 )
(5) Simulation 결과 파형
(6) Simulation 결과 분석
◉ 결과분석
■ 실험 방법
■ 주의사항
(1) 상태도
(2) 상태표
(3) 설계과장(플립플롬 입력식 (간략화))
(4) 설계도 ( 회로도 )
(5) Simulation 결과 파형
(6) Simulation 결과 분석
◉ 결과분석
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(3) 설계과장(플립플롬 입력식 (간략화))
(4) 설계도 ( 회로도 )
(5) Simulation 결과 파형
(6) Simulation 결과 분석
1_) Y = 0
2_) Y =1
3_) Y=0 and Y=1
결과분석
위처럼 3bit ( 0~7 ) 까지의 카운터를 T 플립플롭을 이용하여 설계해 보았다.
본인은 Y의 입력값을 주어 0이되면 “다운“ / 1이 되면 ”업” 이 되게 설계를 해보았다.
회로를 설계후 시뮬레이션을 본후 회로가 정상동작됨을 볼 수있었다.
1_) 에서는 Y=0 일 때 0,7,6,5,4,3,2,1,0 순으로 다운카운터가 동작되는 것을 보였고,
2_) 에서는 Y=1 일 때 0,1,2,3,4,5,6,7 순으로 업 카운터가 동작되는 것을 보였다.
3_) 에서는 Y=0 , 1 두 값을 넣어주어 300ns에서까지는 “다운”카운터 300ns이후에는 “업”카운터를
설계해 동작됨을 확인하였다.
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(3) 설계과장(플립플롬 입력식 (간략화))
(4) 설계도 ( 회로도 )
(5) Simulation 결과 파형
(6) Simulation 결과 분석
1_) Y = 0
2_) Y =1
3_) Y=0 and Y=1
결과분석
위처럼 3bit ( 0~7 ) 까지의 카운터를 T 플립플롭을 이용하여 설계해 보았다.
본인은 Y의 입력값을 주어 0이되면 “다운“ / 1이 되면 ”업” 이 되게 설계를 해보았다.
회로를 설계후 시뮬레이션을 본후 회로가 정상동작됨을 볼 수있었다.
1_) 에서는 Y=0 일 때 0,7,6,5,4,3,2,1,0 순으로 다운카운터가 동작되는 것을 보였고,
2_) 에서는 Y=1 일 때 0,1,2,3,4,5,6,7 순으로 업 카운터가 동작되는 것을 보였다.
3_) 에서는 Y=0 , 1 두 값을 넣어주어 300ns에서까지는 “다운”카운터 300ns이후에는 “업”카운터를
설계해 동작됨을 확인하였다.
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