목차
< 1. 목 적 >
< 2. 이 론 >
< 3. 실험 과정 및 실험 결과 예상 (시뮬레이션) >
< 4. 참 고 문 헌 >
< 2. 이 론 >
< 3. 실험 과정 및 실험 결과 예상 (시뮬레이션) >
< 4. 참 고 문 헌 >
본문내용
80°
5,100
2V
1V
2
180°
3,300
3V
1V
3
180°
2,000
5V
1V
5
180°
20,000
0.5V
1V
0.5
180°
30,000
0.33V
1V
0.33
180°
<시뮬레이션>
=10KΩ
=5.1KΩ
=3.3KΩ
=2KΩ
=20KΩ
=30KΩ
→ 시뮬레이션 결과 반전 연산증폭기이기에 위상차는 180° 가 되었다. 값이 값보다 커지면 증폭기의 이득이 1보다 작아짐을 분수 있다.
2) 비반전 연산증폭기
(1) 그림 1-7의 회로를 구성한다.(입력전압:Vin =9 Vp-p, 입력주파수:1㎑)
(2) 표 1-2에 지시된 RR값으로 변화시키면서 표를 완성한다.
gain
/
Phase[°]
output
input
10,000
10,000
18V
9V
2
0°
5,100
27V
9V
3
0°
3,300
36V
9V
4
0°
2,000
54V
9V
6
0°
20,000
13.5V
9V
1.5
0°
30,000
11.97V
9V
1.33
0°
<시뮬레이션>
=10KΩ
=5.1KΩ
=3.3KΩ
=2KΩ
=20KΩ
=30KΩ
→ 시뮬레이션 결과 그래프가 각이 지게 나온 이유는 증폭기의 전원이 15V라서 증폭된 출력전압이 15V를 넘지 못하기 때문이다. 비반전 연산증폭기이기 때문에 입력전압과 출력전압의 위상차는 0° 이다.
< 4. 참 고 문 헌 >
- FUNDAMENTALS OF MICROELECTRONICS, RAZAVI, WILEY, 2008.
- FEEDBACK CONTROL OF DYNAMIC SYSTEMS, F.FRANKLIN,
PEARSON PRENTICE HALL, 2010.
5,100
2V
1V
2
180°
3,300
3V
1V
3
180°
2,000
5V
1V
5
180°
20,000
0.5V
1V
0.5
180°
30,000
0.33V
1V
0.33
180°
<시뮬레이션>
=10KΩ
=5.1KΩ
=3.3KΩ
=2KΩ
=20KΩ
=30KΩ
→ 시뮬레이션 결과 반전 연산증폭기이기에 위상차는 180° 가 되었다. 값이 값보다 커지면 증폭기의 이득이 1보다 작아짐을 분수 있다.
2) 비반전 연산증폭기
(1) 그림 1-7의 회로를 구성한다.(입력전압:Vin =9 Vp-p, 입력주파수:1㎑)
(2) 표 1-2에 지시된 RR값으로 변화시키면서 표를 완성한다.
gain
/
Phase[°]
output
input
10,000
10,000
18V
9V
2
0°
5,100
27V
9V
3
0°
3,300
36V
9V
4
0°
2,000
54V
9V
6
0°
20,000
13.5V
9V
1.5
0°
30,000
11.97V
9V
1.33
0°
<시뮬레이션>
=10KΩ
=5.1KΩ
=3.3KΩ
=2KΩ
=20KΩ
=30KΩ
→ 시뮬레이션 결과 그래프가 각이 지게 나온 이유는 증폭기의 전원이 15V라서 증폭된 출력전압이 15V를 넘지 못하기 때문이다. 비반전 연산증폭기이기 때문에 입력전압과 출력전압의 위상차는 0° 이다.
< 4. 참 고 문 헌 >
- FUNDAMENTALS OF MICROELECTRONICS, RAZAVI, WILEY, 2008.
- FEEDBACK CONTROL OF DYNAMIC SYSTEMS, F.FRANKLIN,
PEARSON PRENTICE HALL, 2010.
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