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전류가 나누어지는데, 각 저항에 흐르는 전류는 옴의 법칙에 의하여 구한다.
ㅡ>각각의 저항에 흐르는 전류와 전체 전류 및 합성저항과의 관계식
3. Data 및 결과
(1)동일한 값을 값는 3개의 저항일 때
색코드
1 2 3 4
색코드값
측정값
실험오차
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회로망을 접속하였을 때 전원회로를 하나의 전류원과
병렬 저항으로 대치한다.
2. G0 : 전류원을 개방하고 출력단에서 구한 합성저항. (1)전기회로
(2)옴의 법칙
(3)저항의 접속
(4)전위의 평형
(5) 키르히호프의 법칙
(6)회로망정리
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회로실험」; 출판사-희중당, 저자-이병기
-「전기전자공학도를 위한 기초회로실험」; 출판사-웅보, 저자-이능헌, 이덕출, 신영화, 최동진
-「회로이론실험」; 출판사-두양사, 저자-이준신, 윤석호, 박기헌 공저
- 「Electric circuits」; 8판, Nilsson
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* 검토 및 토의 사항
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실험 4.2의 결과를 같은 그래프에 그려서 제출하라. 이 결과를 비교, 분석하라. 공진주파수, 반전력주파수, 대역폭, Q-인자의 이론값과 실험값을 비교하라. 오차는 몇 %인가? 또 오차의 원인은 무엇이라 생각하는가?
5.3 실험이 잘 되었다고 생각
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실험 3,4,6의 결과를 이용하여 계산하라.
(5) 실험 7에서 구성한 회로의 논리식을 각각 구하라.
- (((W+X')'·Y')')' = (W+X)'·Y' = W'·X·Y'
- ((W'·X)'+Y)' = (W'·X)·Y' = W'·X·Y'
이 두 회로는 등가회로이다. 1. 실험 목적
2. 사용기기 및 부품
3. 실험 내용
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실험 결과 (시뮬레이션)
PSpice 모의실험 - Ch.2 반파 및 전파 정류, 클램퍼 회로
PSpice를 통해 주어진 회로를 구성하여 시간 영역(과도)해석을 수행하라. 또한, 회로의 schematic 및 입력전압(Vin), 출력전압(VO)의 파형을 해당 표에 포함하여 시뮬레이
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전류값을 사용하여, 총 전류는 각 지로전류의 합과 같다는 사실을 보여서 이 회로에 대한 키르히호프의 전류법칙을 정명해 보아라. 보고서의 ‘결과분석 및 결론’부분에 증명과정을 적어본다.
8) 실험회로로부터 R을 제거하여 저항이 타서
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사탕 통을 지나가게 되는데, 다른 사람들이 사탕을 먹는 것을 알지 못하게 먹기 위해서 한 번에 남아 있는 사탕의 10%씩만 먹었다. 몇시간 동안 시간에 따른 남아있는 사탕의 수를 그래프로 그려라. 축전지 예비보고서
축전지 결과보고서
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회로로 구성 되었을 때 어떠한 특징을 가지는지 알아 보았
다. 이론적으로만 배웠던 회로이론을 실험을 통해 정말로 체험해 보는 의미있는 시간이
었다.
예비보고서의 시뮬레이션과 결과값 비교
<시뮬레이션>
인가전압
[V]
전류[mA]
I
I1
I2
I
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