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시립대 전전설2 Velilog 결과리포트 2주차
목차
1.실험 목적
2.배경 이론
1) Xilinx ISE의 특징
2) Xilinx ISE Design Entry
3) Xilinx ISE Compilation
4) Isim Simulator
5) AND Gate
3.실험 장비
1) 장비
2) 부품
4.실험 결과
1)AND
2) HalfAdder
5.결론 및
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Design counter with Piezo -> 동작 검사
3) 0000 ~ 1001, 즉 0 ~ 9 까지 값을 가지는 4-bit bcd 입력을 받아서 single FND 를 제어하는 8-bit 신호 (‘점‘을 포함) out 을 출력하는 모듈
4) FND array 를 제어하기 위하여 다음과 같은 선언부 및 변수를 가지는 모듈
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Design counter with Piezo -> 동작 검사
3) 0000 ~ 1001, 즉 0 ~ 9 까지 값을 가지는 4-bit bcd 입력을 받아서 single FND 를 제어하는 8-bit 신호 (‘점‘을 포함) out 을 출력하는 모듈
4) FND array 를 제어하기 위하 에 해당하는 자세한 내용들을 작성해놓았
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시립대 전전설2 Velilog 결과리포트 5주차
목차
1.실험 목적
2.배경 이론
1)3x8 decoder
2) 21 MUX
3) 41 MUX
4) BCD Code (8421 코드)
5) Excess-3 Code ( 3초과코드 )
3.실험 장비
1) 장비
4.시뮬레이션 결과와 실험 결과의 비교
1)38Decoder
2)41Mux
3
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시립대 전전설2 Velilog 결과리포트 4주차
목차
1. 실험 목적
2. 배경 이론
3. 실험 장비
4. 시뮬레이션 결과와 실험 결과의 비교
5. 코드 분석 및 고찰
6. 결론
7. 참고문헌
1. 실험 목적
시립대 전자전기설계 2에서 실시한 Velilog
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(완전 세세한 정리, 끝판왕) 시립대 전전설2 9주차 Lab09 결과 레포트 LCD Control 전자전기컴퓨터설계실험2,
목차
1. 실험 결과
1) Text LCD에 학번과 이름을 출력
2) Text LCD에 학번과 이름을 출력하되 길거리 광고판처럼 글자가 왼쪽으로 한 칸
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서울시립대학교 전전설2 8주차 결과레포트(코딩 성공적, A+, 10점 만점 11점)
목차
1. Results of this Lab (실험 결과)
가. Results of Lab 1.
나. Results of Lab 2.
다. Results of Lab 3.
라. Results of Lab 4.
마. Results of Lab 5.
바. Results of Lab 6.
2. Discus
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서울시립대학교 전전설2 3주차 예비레포트(코딩 성공적, A+, 10점 만점 11점)
목차
1. Introduction (실험에 대한 소개)
가. Purpose of this Lab
나. Essential Backgrounds (Required theory) for this Lab
2. Materials & Methods (실험 장비 및 재료와 실험 방법)
가
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서울시립대 전자전기설계2(전전설2) 4주차 사전보고서
목차
1. always 구문과 initial 구문의 차이점에 대하여 조사하시오.
2. 테스트벤치 구문에서 20ns 주기로 1과 0을 토글링 하는 신호를 생성하는 코드를 작성하시오.
3. 2‘s complement(2진 보
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서울시립대 전자전기설계2(전전설2) 7주차 결과보고서
목차
0. 기본 숙지 사항
1. 실습0 Synchronzied 신호 생성 코드 작성
2. 실습1 Moore머신 작성
3. Mealy머신 작성
4. 응용과제
5. 최종정리
0. 기본 숙지 사항
전자전기설계2(전전설
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