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실험 시 작용하는 다른 요소들을 고려해 보았을 때에, 수 V의 여유를 더 주어야 한다고 생각했다. 그림은 실험시 사용할 Op-Amp는 741 IC칩의 datasheet이다. 과도한 입력전압을 가해줄 시 칩이 타버리는 경우가 있으니 조심하여야하고, 칩에는 고정
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비교하시오.
PSPICE 회로도
TIME DOMAIN
미분기이기 때문에 입력파형에 대한 출력파형은 입력파형을 미분한 그래프가 나타나게 된다. 미분기의 전달함수를 보면, 인 것을 확인할 수 있다. 1. 실험목적
2. 실험과정 및 예상되는 결과
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°)/100]+[(0.8421∠-47.048°)/4700]=0.0045∠7.4765°
4.4689∠0°을 1k으로 나눈 값과 거의 비슷하게 나타는 것을 확인할 수 있다.
3. 실험 결론
이번실험은 RLC회로에서 KCL과 KVL이 성립하는지 Phasor측정을 통하여 확인하는 실험이었다. 실험자체는 어렵지 않
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정하고 주파수는 각각 , , 에 대해 각 전압의 phasor를 (즉 크기와 위상) 측정한다. 과 는 실험 4.1에서 측정한 부품을 사용하시오. 각 저항 값을 측정하여 이론값을 계산할 때 사용하시오.
(2) 각 주파수에 대해 전압의 크기 및 위상을 측정하시오.
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time constant와 의 값을 각각 측정하시오.
2배인 경우: time constant = 0.02ms 0.5
배인 경우: time constant = 0.005ms 2
[그림 5] [그림 6] [그림 7]
[그림 8] 1. 실험목적
2. 실험이론
3. 기기 및 부품
4. 실험과정 및 예상되는 결과
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회로
(1) 4.1은 저역통과 필터회로에 대한 실험으로 입력 신호의 고주파 성분이 어느 정도 차단된다는 것을 실험을 통해 입증하였다. 이 회로의 출력을 다시 같은 저역통과 필터를 통과시키면 입력의 고주파 성분은 거의 차단될 수 있을 것이다
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실험 결론
첫 번째 실험은 중첩의 원리를 저항회로에서 확인하는 실험이었다. 중첩의 원리는 각 전압원이 회로에 흐르게 하는 전류와 걸리는 전압을 각각 더하면 두 개가 동시에 존재할 때의 값과 같게 되는 것을 말하는데 이는 전기회로이론
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실험 결론
(b415039 김정섭)
이번 실험은 Op-Amp를 응용한 회로들을 실험하고 이 실험결과와 이론을 확인하는 실험이었다. 이상적인 Op-Amp에서의 특징과 실제 결과를 잘 비교하면서 실험을 진행했다. 첫 번째로 구성한 회로는 반전 연산 증폭기이
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위상을 변화시키는 특성을 가지고 있었다. 이론적인 배경을 확실하게 알고서 실험에 임한다면 더욱 효율적인 실험이 될 것임을 확인할 수 있는 좋은 경험이었다. 1. 실험과정 및 실험결과
2. 실험결과 분석
3. 실험 결론
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회로
TIME DOMAIN
steady state에서 37%가 되는 지점까지 떨어지는데 걸린시간은 대략적으로 6.1566로 나타남을 확인할 수 있다.
다음과 같이 가변저항의 b부분과 Inductor를 직렬로 연결한다. 이 회로는 처음에는 1이기 때문에 가장 첫 번째 실험의 회로
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