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회로를 구성해야지만 보다 정확한 실험 결과값을 얻을 수 있었다.
- 나. 병렬 RLC 공진 회로의 주파수 응답
두 번째 과 를 사용한 실험에서 전압의 값이 1.5V정도로 계속 크게 나왔다. 저항이 1K옴으로 매우 크므로 작은 전압이 측정되어야 했다.
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전압(-0.9992V)
입력 전류 0.4mA일때, 출력 전압(-3.9992V)
입력 전류 0.6mA일때, 출력 전압(-5.9992V)
입력 전류 0.8mA일때, 출력 전압(-7.9991V)
0.1mA
-0.9992V
0.4mA
-3.9992V
0.6mA
-5.9992V
0.8mA
-7.9991V
전류-전압 변환기 회로
→ 시뮬레이션 결과를 통해, 를 증명 할 수
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회로와 등가 Y형 회로의 단자전압 의 결과가 서로 비슷함을 보여준다. 이것도 이론적으로는 동일한 값을 보여야 하나, 위와 설명한 바와 같이 약간의 저항값의 차이에서 발생하였다.
3. 실험 기기 및 부품
- DC 전원공급기
- 디지털 멀티미터
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결과는 입력전압이 다르다는 것을 생각하면 동일한 결과를 출력했다고 할 수 있다.
-출력 전압 조정
R2 ,
Vout , V
47
10.36V
100
12.84V
180
16.92V
이번엔 회로도를 다른 형태로 꾸며 부하저항의 크기에 따른 출력전압을 알아보았다. 부하저항이 47 일 경
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회로를 직접 실험을 해보니 회로에 대한 이해도 더 좋아졌고 실제로 파형이 책에 있는 것과 유사하게 나오니까 신기했다. 여러 가지 측면에서 만족스러운 실험이었다. 실험. Timer LM555실험 : 비안정 바이브레이터
1.Orcad 결과
2. 실험 결
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결과를 고찰한다.
브리지 회로를 구성하여 보고, 각 저항간의 관계를 살펴본다.
4. 실험준비물 : power supply, 저항(0.1, 0.5, 1, 2, 3, 10㏀), 멀티미터,
가변저항, 함수발생기
5. 실험절차
1. 아래와 같은 회로를 구성하고, 회로에 표시된 전압과 전류값
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전압이 0V에서 10V까지 상승하려면 20μs가 소요된다. 일반적인 741의 출력은 이러한 속도보다 더 빨리 변할 수는 없다.
모의실험
① 연산 증폭기의 이득
위는 pspice 회로도이다.
왼쪽 그래프는 OFFSET을 3V, AMPL를 500mV 주었을 때의 시뮬레이션 결과이
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전압값 출력)
V1 : 회로에 걸어주는 전압
R1 : / 10KΩ
R6 : / 10kΩ (부하저항)
R3 : 감생저항(130Ω) 0.0005Ω
※ 참고 : R3의 변화가 이득과 밴드폭에 어떻게 영향을 주는지 확인하기 위해서 0Ω을 인가하려고 하였으나 0Ω 인가 시 PSPICE 결과 값이 나오지 않
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dB 이다.
실제로 회로를 네 회로를 연결하면 Voltage Gain = 90.441 dB가 된다.
3dB cutoff frequency fL = 100Hz, fH = 100kHz가 된다.
C. 결과 고찰 및 문제점
이론으로 얻은 전체 회로의 전압이득은 87.432 dB이고 실제로 회로를 연결해서 시뮬레이션 하여 얻은 전압
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작은 요소가 큰 변화를 만들 것이다. 이번 실험에선 하지 않았지만 기본적인 정류회로에 캐패시터를 달아 평활회로를 만들었을땐 어떤 결과를 나타낼지 생각해보면 많이 도움될 것 같다. 1. 실험회로
2. 실험결과
3. 결론 및 토의
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