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N극과 S극의방향을 바꿔 떨어뜨렸을 경우에는 그래프의 형태가 뒤집히기도 했었다.
(1)유도기전력이란 무엇인가?
전자기 유도에 의해 생기는 전기력으로 1831년 패러데이가 발견한 현상이다. 폐회로 가까이에서 자석을 움직이거나 전류가 흐르
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회로는, 실수로 이 되는 경우, 출력 전류가 너무 커져서 또는 가 파괴되기 쉬운 회로이다. 이런 문제점을 해결하려면 [그림10-1]의 회로를 어떻게 바꾸면 좋은가?
아래와 같이 기존의 회로에 short circuit protection회로를 결합시켜 준다.
위의 그림
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회로의 병렬연결을 통해서 V와 I의 값을 측정하는 실험이었다. 조교님께서도 병렬연결 실험은 복잡하다고 말씀하시면서 전선의 개수를 최소로 사용하는 것이 효율적이고 잘 된 회로 구성이라고 말씀해주셨다. 직렬연결에 대한 실험을 모두
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회로를 입력하라. V4 의 크기는 10V, 주파수는 1kHz 로 하라. 5ms 간 Time Domain Analysis 를 수행하고, V4 와 출력 전압을 하나의 그래프에 도시하라. V5 를 1V, V6 를 0V 로 바꾸고, 반복하라.
⇒ 두 개의 증폭기에 들어가는 입력을 (-)와 (+)각각 다른 입력으
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회로의 동작을 설명해 보도록 하겠다.
superposition principle을 이용 을 와 식으로 나타내면,
로 나타낼 수 있다. 임의로 이 회로가 인 안정 상태에 있다고 한다면, 이 회로를 다른 안정 상태에 있도록 트리거 시키려면, 는 반드시 -가 되어야하며,
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회로의 동작을 확인하라.
4번실험은 3개의 입력을 받아서 0과 1중에 많이 입력된 값을 출력하는 회로이다. 만약 3개의 입력값이 0,0,1 이라면 0과 1중에 개수가 많은 0값을 출력하게되고, 입력값이 1,0,1 이라면 1을 출력하는 동작을 하게된다. 이
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회로를 수정하여 다음의 회로를 구성하라.
- Orcad 프로그램을 이용하여 그린다.
(6) AC Sweep Analysis 를 수행하여 이득의 주파수 특성을 구하라. 이 때, Sweep 주파수는 1Hz부터 10MHz 로 하고, points 는 1000으로 하라. U1 의 출력전압의 dB magnitude 와 phase
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회로 2 결과
74LS76 IC의 JK Flip-Flop을 이용하여 T Filp-Flop으로 변환한 회로의 동작을 확인하라.
회로도
시뮬레이션
표
T
Q(t)
Q(t+1)
1
4.519(그림 2_1)
0.047(그림 2_2)
0
4.446(그림 2_3)
4.462(그림 2_4)
F/F은 기억 소자라서 시간에 따라 값이 변한다. 위 표는 어
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회로해석
제너다이오드의 소자 모형은 위의 그림기호에 나타나 있다. 그리고 제너다이오드를 사용한 기본적인 회로을 해석 하자면 우선 제너다이오드가 “on"상태일 때와 ”off" 상태 일 때가 있다. “on"상태일 때는 제너다이오드에 걸리는 전
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회로를 구성하라. 이 때, V3 는 VAC 를 이용하고 진폭은 100mV 로 하라.
- Orcad 프로그램을 이용하여 그린다.
(2) AC Sweep Analysis 를 수행하여 이득의 주파수 특성을 구하라. 이때, sweep 주파수는 1Hz부터 10MHz 로 하고, points 는 1000 으로 하라. U1 의 출력
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