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요소로 작용한다. 1. 2의 배수를 판별하기 위한 진리표 작성과 Boolean Algebra를 통한 논리 회로의 간소화
2. 4K ROM과 1K RAM 4개를 활용한 8비트 마이크로컴퓨터 설계 및 구성도
3. 전파 지연을 포함한 3입력 논리식의 표현과 해당 회로의 도식화
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D
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↑
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0
1
<실험 6>
회로 구성 및 입·출력 값.
고찰
이번 시뮬레이션은 JK플립플롭 4비트 우 쉬프트 레지스터에 관한 시뮬레이션이다. 교재의 이론 부분에 나와
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으로써 각 플립플롭의 출 력은 인접한 플립플롭으로 넘겨지는 구조의 레지스터
☞ 시프트 레지스터 사용 예 : 전자계산기
- 시프트 레지스터 (shift register)의 종류
D 플립플롭 이용
JK 플립플롭 이용
- 시프트 레지스터 (shift register)의 응용
이
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플립플롭의 출력을 반전시켜 가장 왼쪽의 플립플롭 입력으로 전달하는 형태를 갖는다.
[그림 8-2] 링 카운터와 존슨 카운터의 구성
예비 보고서
D 플립플롭을 사용하여 직렬 입력/병렬 출력이 되는 4 비트 쉬프트 레지스터를 설계하시오.
J-K 플
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플립플롭 : 순차 논리 회로에서 쓰이는 메모리 요소로써, 0 또는 1의 두가지 안정 상태를 갖는 쌍안정 멀티바이브레이터로 두 상태 중 한 상태에 머물러 있게 하는 것
(4) 레지스터 : 2진 정보를 저장하는 기억소자로서 플립플롭이 여러 개 모인
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플립플롭은 직렬입력을 통해 새로운 2진 정보를 받아들인다
○ 논리 시프트(Logical Shift)
- 출렬입력으로 0이 전송된다
- 기호로는 Shl, Shr로 표시
R1←Shl R1
R2←Shr R2
○ 순환 시프트(Circulation)
- 시프트 레지스터의 직렬출력을 직렬입력에 연
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.(n은 플립플롭의 수)
6. 참고문헌
* 디지털 디자인 (M, Morris Mano, Michel D, Ciletti : 교보문고)
* http://terms.naver.com/
*http://blog.naver.com/pegacissus?Redirect=Log&logNo=8010924(74194회로) 1. 서 론
2. 이 론
3. 실 험
4. 결과 및 논의
5. 결론
6. 참고문헌
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레지스터의 값을 0x9B로 초기화하며 이는 모든 포트를 모드 0과 입력으로 설정한다.
컨트롤 레지스터로 각 포트의 동작을 결정한다. 모드 0일 때, 각 포트는 범용 입/출력 포트로 동작하고 A, B, CL, CU가 포트(8비트)단위로 입/출력되고 비트 단위
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D는 최상위 비트(MSB)를, 문자 A는 최하위 비트(LSB)를 나 타낸다.
2. 보고서의 그림 8-4에 나타낸 Karnaugh 맵을 완성하라. 관련이론에 설명한 규칙 에 따라 1들을 그룹지어라. 맵으로부터의 최소 SOP를 읽어 무효 코드에 대한 표 현식을 찾아라. 보고
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D로 표시되고 LSB는 문자 A로 표시되어진다.
2. 보고서의 그림 8-4에 제시된 카노맵을 완성한다. 이론 요약에서 설명한대로 1셀을 그룹으로 만든다. 맵에서 최소 곱의 합(SOP)을 묶음으로써 부당한 코드 표현식을 찾아낸다. 보고서의 준비된 여백
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