목차
1. 실험 내용
2. 실험 결과
2. 실험 결과
본문내용
std_logic
);
end component;
begin
key : comp_4bit
port map(input_a,input_b,output_eq,output_agb,output_alb);
input_a <= "0000", "1000" after 100 ns; -- 입력 시그널을 4비트로 생성, “”사용
input_b <= "0000", "1111" after 200 ns; -- 모든 경우에 대한 입력을 생성하기 어려우므로 샘플링을 위해 세 가지 입력신호 조합을 만들어 주었다
end tb_comp_4bit_arc;
2-3) Results
4비트 입력을 처리해야 한다는 것이 이번 실험의 가장 큰 특징이었다. std_logic_vector구문으로 여러비트 신호를 선언 할 수 있는데 0 to 3이나 3 downto 0의 두가지 방법으로 4비트를 지정 해 줄 수 있었다. downto를 일반적으로 더 자주 사용한다는 조교님의 설명에 따라 3 downto 0를 이용해 신호를 선언했다. 4 downto 1이 아님에 주의해야 했다.
결과 파형을 보면 a와 b 각각 입력의 4비트는 그래프 모양으로는 식별이 불가했다. 하지만, 각 신호마다 0000, 1000, 1111, 등의 첨자가 붙어 있어 입력의 변화를 파악 할 수 있었다. 모든 경우에 대한 실험을 진행하기가 까다로우므로 그 중 3가지의 경우에 대한 신호를 2가지 신호의 조합으로 생성해주고 결과를 출력하였는데 테이블에 명시된 값들과 일치되는 결과를 보였다.
테스트를 할 때 역시 입력에 연결해준 포트로 4비트 신호를 생성해서 보내줘야 한다는 것에 주의해야 했다.
);
end component;
begin
key : comp_4bit
port map(input_a,input_b,output_eq,output_agb,output_alb);
input_a <= "0000", "1000" after 100 ns; -- 입력 시그널을 4비트로 생성, “”사용
input_b <= "0000", "1111" after 200 ns; -- 모든 경우에 대한 입력을 생성하기 어려우므로 샘플링을 위해 세 가지 입력신호 조합을 만들어 주었다
end tb_comp_4bit_arc;
2-3) Results
4비트 입력을 처리해야 한다는 것이 이번 실험의 가장 큰 특징이었다. std_logic_vector구문으로 여러비트 신호를 선언 할 수 있는데 0 to 3이나 3 downto 0의 두가지 방법으로 4비트를 지정 해 줄 수 있었다. downto를 일반적으로 더 자주 사용한다는 조교님의 설명에 따라 3 downto 0를 이용해 신호를 선언했다. 4 downto 1이 아님에 주의해야 했다.
결과 파형을 보면 a와 b 각각 입력의 4비트는 그래프 모양으로는 식별이 불가했다. 하지만, 각 신호마다 0000, 1000, 1111, 등의 첨자가 붙어 있어 입력의 변화를 파악 할 수 있었다. 모든 경우에 대한 실험을 진행하기가 까다로우므로 그 중 3가지의 경우에 대한 신호를 2가지 신호의 조합으로 생성해주고 결과를 출력하였는데 테이블에 명시된 값들과 일치되는 결과를 보였다.
테스트를 할 때 역시 입력에 연결해준 포트로 4비트 신호를 생성해서 보내줘야 한다는 것에 주의해야 했다.
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