VHDL 에 대해

목차

1. VHDL의 의의

2. VHDL의 종류
1) Verilog-HDL
2) AHDL
3) UDL/I

3. VHDL의 역사적 배경

4. VHDL의 특징
1) 표준화된 HDL
2) 이용의 확대
3) 설계 기술 능력
4) 언어로서의 기능

5. VHDL의 표현방법(Y 차트라고함)
1) Behavioral modeling
2) Dataflow modeling
3) Structural modeling

6. 한국의 VHDL

본문내용

출력까지의 경로 표현을 위주로 한다. Behavioral modeling 단계보다는 하드웨어에 가깝게 기술한다.
3) Structural modeling
세가지 모델링 중에서 하드웨어에 가장 가까운 표현으로서모든 컴포넌트 뿐만 아니라 이들의 상호연결도를 나타낸다. 즉 레지스터와 버스뿐만 아니라 게이트 수준의 설계를 가능하게 한다.

6. 한국의 VHDL
국내에서는 80년대 말쯤에 CADENCE TOOL을 사용하는 몇몇 대기업에서 Verilog-HDL을 일부 사용하고있었으나 극히 제한적이었다. 이즈음 VHDL도 발표가 되어 연구소와 학계에서는 국내 HDL 표준화 문제가등장하게 되었다. 결국 Verilog-HDL과 VHDL 둘중의 하나를 선택하는 일이었다.
그당시 Verilog-HDL은 CADENCE라는 회사 전용 언어이고, VHDL은 IEEE에서 표준화된 언어이기때문에 쉽게 VHDL에 관심을 가지게 되었다. 그러한 배경으로 1988년도부터 ETRI,인천대,홍익대와공동으로 VHDL에 관한 연구(주로 TOOL개발)를 하게 되었다. 이때도 대기업들만이 관심을 갖고 있던 터라 ASIC이라는 말도 생소하거니와 VHDL은 더더욱 낯설은 단어였다.
90년대 들어서, 상업용툴이 등장하게 되었는데, 한마디로 놀라운 작품이었다.
시뮬레이터로는 Vantage 그다음 합성기로는SYNOPSYS가 나오고, 이후 여러회사들이 발표하게 되었다. 지금이야 전자과 학생들은 웬만하면 VHDL을 다 접하고 있으니 놀라운 발전이라 할수 있다. 물론 시스템 업체를 포함한 대부분의 전자관련 업체에서도 지대한 관심을 가지고 있다 할수 있다.

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