목차
1. 불 대수(Boolean Algebra)
1) 불 대수의 기본공식
2) 카르노도(Kamaugh Map 또는 K-Map)를 이용한 간략화
(1) 카르노도의 특징
(2) 변수가 2개인 경우
(3) 변수가 3개인 경우
2. 기본 논리 게이트(Logic Gate)
3. 조합논리회로
1) 특징
2) 반가산기(Half-Adder,HA)
3) 전가산기(Full-Adder,FA)
4) 디코더(Decoder)
5) 멀티플렉서(Multiplexer,MUX)
6) 디멀티플렉서(Demultiplexer)
4. 순서 논리회로
1) 플리플롭(Flip-Flop)
2) RS 플리플롭
3) JK 플리플롭
1) 불 대수의 기본공식
2) 카르노도(Kamaugh Map 또는 K-Map)를 이용한 간략화
(1) 카르노도의 특징
(2) 변수가 2개인 경우
(3) 변수가 3개인 경우
2. 기본 논리 게이트(Logic Gate)
3. 조합논리회로
1) 특징
2) 반가산기(Half-Adder,HA)
3) 전가산기(Full-Adder,FA)
4) 디코더(Decoder)
5) 멀티플렉서(Multiplexer,MUX)
6) 디멀티플렉서(Demultiplexer)
4. 순서 논리회로
1) 플리플롭(Flip-Flop)
2) RS 플리플롭
3) JK 플리플롭
본문내용
1의 입력값에 의해서만 결정되는 회로
기억회로를 갖고 있지 않음
종류 : 반가산기, 전가산기, 반감산기, 디코더, 인코더, 멀티플렉서, 디멀티플렉서 등
2) 반가산기(Half-Adder,HA)
2개의 비트 X,Y를 더한 합 S와 자리올림 C를 구하는 회로
3) 전가산기(Full-Adder,FA)
2개의 비트 X,Y와 밑의 자리로부터 자리올림한 C(Carry)까지 고려하여 비트 3개를 덧셈하는 회로
4) 디코더(Decoder)
입력으로 들어오는 2진 신호의 조합을 검출하여,유일한 출력만을 생성하는 회로
n개의 입력 변수가 있을때는 2n개의 출력을 가짐
5) 멀티플렉서(Multiplexer,MUX)
2n개의 입력선 중에서 2진 정보를 선택해서 한개의 출력선에 전송하는 회로
입력선에서 출력으로 경로가 생성될수 있도록 n개의 선택선(Selection Line,Control Line)을 가지고 있음
멀티플렉서의 크기가 입력선의 개수로 정해지는 2n × 1장치
6) 디멀티플렉서(Demultiplexer)
한 개의 입력을 받아들여서 n개의 선택선에 의해 조절되는 2n
개의 출력을 생성하는 회로
여러 곳에 클록 신호를 보내는 용도에 사용
4. 순서 논리회로
플리플롭과 게이트들로 구성되고, 회로 내부에 기억 소자를 가지고 있어서 입력값과 기억소자의 상태에 따라 출력 값이 결정되는 논리회로
1) 플리플롭(Flip-Flop)
1비트의 정보를 저장할 수 있는 장치로 정상 출력과 보수화된 출력(Q,Q')을 가짐
Q = 1 : Set, Q = 0 : Reset
클록(Clock,C)이라는 제어입력(Triggering)을 가지며 입력 신호가 상태 변환을 일으키기 전까지는 원래의 상태를 유지
종류 : RS 플리플롭, D 플리플롭, JK 플리플롭, T 플리플롭
2) RS 플리플롭
S(Set), R(Reset), C(Clock)의 입력과 Q,Q'의 출력을 가짐
클록 C에 신호가 들어오지 않으면 S나 R의 입력의 값에 관계없이 출력은 변화가 없음
Q(t)
는 현재 상태의 출력값을 Q(t+1)은 클록 신호가 변한 다음 상태의 값을 나타냄
S = R = 1인 경우는 출력값이 미결정 상태이기 때문에 거의 사용되지 않음
3) JK 플리플롭
SK 플리플롭에서 S = R = 1인 경우에 발생하는 문제점을 보완한 플리플롭
J와 K는 SR 플리플롭의 S와 R에 해당
J = K = 1일 때 Q'(t)
를 출력
기억회로를 갖고 있지 않음
종류 : 반가산기, 전가산기, 반감산기, 디코더, 인코더, 멀티플렉서, 디멀티플렉서 등
2) 반가산기(Half-Adder,HA)
2개의 비트 X,Y를 더한 합 S와 자리올림 C를 구하는 회로
3) 전가산기(Full-Adder,FA)
2개의 비트 X,Y와 밑의 자리로부터 자리올림한 C(Carry)까지 고려하여 비트 3개를 덧셈하는 회로
4) 디코더(Decoder)
입력으로 들어오는 2진 신호의 조합을 검출하여,유일한 출력만을 생성하는 회로
n개의 입력 변수가 있을때는 2n개의 출력을 가짐
5) 멀티플렉서(Multiplexer,MUX)
2n개의 입력선 중에서 2진 정보를 선택해서 한개의 출력선에 전송하는 회로
입력선에서 출력으로 경로가 생성될수 있도록 n개의 선택선(Selection Line,Control Line)을 가지고 있음
멀티플렉서의 크기가 입력선의 개수로 정해지는 2n × 1장치
6) 디멀티플렉서(Demultiplexer)
한 개의 입력을 받아들여서 n개의 선택선에 의해 조절되는 2n
개의 출력을 생성하는 회로
여러 곳에 클록 신호를 보내는 용도에 사용
4. 순서 논리회로
플리플롭과 게이트들로 구성되고, 회로 내부에 기억 소자를 가지고 있어서 입력값과 기억소자의 상태에 따라 출력 값이 결정되는 논리회로
1) 플리플롭(Flip-Flop)
1비트의 정보를 저장할 수 있는 장치로 정상 출력과 보수화된 출력(Q,Q')을 가짐
Q = 1 : Set, Q = 0 : Reset
클록(Clock,C)이라는 제어입력(Triggering)을 가지며 입력 신호가 상태 변환을 일으키기 전까지는 원래의 상태를 유지
종류 : RS 플리플롭, D 플리플롭, JK 플리플롭, T 플리플롭
2) RS 플리플롭
S(Set), R(Reset), C(Clock)의 입력과 Q,Q'의 출력을 가짐
클록 C에 신호가 들어오지 않으면 S나 R의 입력의 값에 관계없이 출력은 변화가 없음
Q(t)
는 현재 상태의 출력값을 Q(t+1)은 클록 신호가 변한 다음 상태의 값을 나타냄
S = R = 1인 경우는 출력값이 미결정 상태이기 때문에 거의 사용되지 않음
3) JK 플리플롭
SK 플리플롭에서 S = R = 1인 경우에 발생하는 문제점을 보완한 플리플롭
J와 K는 SR 플리플롭의 S와 R에 해당
J = K = 1일 때 Q'(t)
를 출력
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