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위한 코드*********************
-- ************************ 1의 자리 카운터*****************************************
--*********************1의자리 디코더***************************
--************************************10의 자리 디코더**********************
4. 토의 및 분석
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카운터를 비동기식으로 구성한 예
동기식 카운터(synchronous counter)
○ 설계방법이 어려운 반면에 정확하다.
○ 순차논리회로를 이용하여 설계.
5.Simulation
<실험1>
<실험2>
<실험3>
References
www.alldatasheet.co.kr
pspice 기초와 활용
네이
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회로를 구현 할 수 있다.
9. 결론 및 토의
처음에 부품을 받고 설계를 시작하려 했을 때는 막막하고 어떻게 구성해야 하는지 조차 생각 하지 못했었다. 하지만 인터넷과 책들을 통해 각각의 소자들의 특성을 공부해 가면서 많은 것들을 알아가
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Mod-9 카운터는 0에서 8까지 카운터 된다. 위는 Mod-9 카운터를 VHDL로 설계한 것이다. CLEAR 기능을 추가하여 CLEAR가 1일 경우 출력 Q는 0으로 초기화 되고 다시 0이 될 경우 처음부터 다시 카운터 한다.
[예비실험 2-2] 회로를 구성하여 결과를 확인하
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Counter 실험에서는 10진, 12진, 16진 카운터를 설계하여 검증하였다. 10진과 12진 카운터는 J-K 플립플롭의 7476칩을 기반으로 하여 설계하였고, 16진 카운터는 74LS161을 이용하여 설계하였다. 똑같은 진수의 카운터라고 하여도 여러 가지 회로로 구성
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