베릴로그를 이용한 cpu설계

소개글

베릴로그를 이용한 cpu설계에 대한 보고서 자료입니다.

목차

[luv_cpu_calculator]
[luv_cpu_FPGAsimul]
[luv_cpu_simulation]


743KB
파일 100, 폴더 3




READ ME.hwp……………………………………………9p

1) LCD를 이용한 OPCODE 시뮬레이션
　(동작 주파수 : 1khz -> 1000분주 -> 1hz)
　- 핀설정
　- 동작방법
　- 동작사진


2) 계산기
　- 핀설정
　- 동작방법
　- 동작사진



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최종보고서.hwp………………………………………45p

1. 조이름 및 타임테이블

2. 설계과정(RTL 회로 포함)
(1) CPU 설계조건
(2) 마이크로 프로그램 컨트롤러.
(3) Data path

3. 핀할당 및 동작설명(동작사진 포함)
(1) 시뮬레이션
(2) 어셈블리 프로그램 구현(핀할당포함)
　- LCD를 이용한 OPCODE 시뮬레이션
　- 계산기(세그먼트, 도트매트릭스, LCD이용)

4. Instruction.

5. 제어 ASM Chat.

6. 제어 워드 및 설명

#베릴로그 파일

본문내용

READ ME.hwp



1) LCD를 이용한 OPCODE 시뮬레이션
◉ 핀설정

　≪ 표 - 그림 파일 ≫


◉동작방법
pu 연산자를 이용한 계산기이다. R1과 R2의 연산값을 R3에 저장 한다. 기본적으로 LCD를 통해 모두 실시간으로 표기되며, 동시에 세그먼트를 통해 각 레지스터의 16진수 값이 각각 두 개의 세그먼트를 이용하여 표기된다. R3 = {SEG1,SEG2}, R1={SEG4,SEG5}, R2={SEG7, SEG8}. 표기되는 값 중 16진수 a~f 값들은 점을 찍어주어 모양이 비슷한 숫자와 확실히 구별 되도록 하였다. 초기 상태(S0)에서는 segment가 전에 계산된 값들을 보여준다. 이때, 도트매트릭스에는 계산기 표시로 ‘가감승제’ 연산을 표시해 두었다. \'0\'버튼을 눌러 다음 상태(S1)로 넘기면 도트매트릭스에는 R1이표시되면서 여기서 R1값이 선택가능하다





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최종보고서.hwp




1. 조이름 및 타임테이블(역할분담표 포함)

　≪ 표 ≫


2. 설계과정
(1)CPU 설계조건

　≪ 그 림 ≫

- Data path 와 마이크로프로그램 컨트롤러로 나누어 설계.
- RAM은 16비트의 512개 워드로 구성, 1인스트럭션에 1워드 사용(메모리 내부의 레지스터를 사용하지 말 것)
- ROM은 28비트의 128워드로 구성
- 다수사이클 마이크로프로그램 제어방식 구조(3클럭 사용)
- 1워드의 길이는 16비트. 한 개의 인스트럭션은 1 word (16비트)로 구성
- 레지스터 파일의 레지스터 개수는 9개(R0~R8) R0는 출력레지스터(OUTR)로 사용하여 그 값을 디스플레이로 볼 수 있게
외부 핀에도 연결한다.
- 제어방식은 마이크로 프로그래밍 제어 방식을 사용한다.
- control 메모리의 크기는 128 x 28(비트 수 가변가능)




≪ … 중 략 … ≫




#베릴로그 소스
♡LOVE CPU

module love_cpu(rst, clk, r0,r1,r2,r4,addr,FS,address,Data_out, opcode_t_mux, C1, V1, N1, Z1, C_C, C_V, C_N,C_Z);

input rst, clk;
input C_C, C_V, C_N,C_Z;
output [15:0] r0,r1,r2,r4,addr, Data_out;
output [4:0] FS;
output [7:0]address;
output [7:0] opcode_t_mux;
output C1, V1, N1, Z1;
wire [15:0] Data_out, r0,r1,r2;
wire [15:0] addr;
wire V1,C1,N1,Z1,V,C,N,Z,TA,MB,MD,RW,MW,MM;
wire [4:0] FS;
wire [3:0] DA,AA,BA;
wire [2:0] SB;

키워드

베릴로그,   cpu,   텀프로젝트,   텀프,   verilog,   디지털 실습,   read me,   졸업작품,   fpga