[전기전자 실험] 공통 소스 트랜지스터 증폭기

소개글

[전기전자 실험] 공통 소스 트랜지스터 증폭기에 대한 보고서 자료입니다.

목차

공통 소스 트랜지스터 증폭기

실험 순서
1. Idss와 Vp측정
2. 공통 소스 회로의 직류 바이어스
3. 공통 소스 증폭기의교류 전압 이득
4. 입력과 출력 임피던스 측정
5. 결론 및 토의

본문내용

저항 Rx를 제거하라.
d. Vo를 측정하라.
Vo측정값=0.64V
부하 저항 Rl=10kΩ를 연결하고, 부하 양단의 전압 Vl을 측정하라.
Vl(측정값)=0.34V
다음 식을 이용해 출력 임피던스를 구하라.
Zo(계산값)=8.71MΩ
5. 결론 및 토의
이번 실험은 공통 소스 트랜지스터 증폭기에 대한 실험을 하였습니다.
이번 실험은 JFET의 직류 바이어스는 소자의 전달 특성과 소스 저항에 의해 결정되는 직류 자기 바비어스에 의대 결정됩니다. 이 직류 바이어스 점에서 교류 전압이득은 gm과 같은 소자의 파라미터와 회로의 드레인 저항에 의해 결정된다는 이론을 바탕으로 진행하였습니다.
먼저 트랜지스터의 Idss와 Vp의 값을 측정을 하였습니다. 특성 커브트레이서가 없어 책의 순서에 따라서 측정 할 수 있었습니다.
다음으로 공통 소스 회로의 Vgs와 Id값을 구하는 실험이었습니다. 먼저 식을 통해서 계산값을 구하고 측정하여 측정값과 비교를 해보았습니다. 계산값보다 측정값이 거의 오차 없이 일치하게 측정되었습니다.
교류전압이득 실험에서는 약간의 오차가 발생하였습니다. 그 이유는 계산과정에서 약간의 오차가 있어서 결과값과 측정값의 차기가 발행 한것 같습니다.

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