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실험 기구 및 부품
? DC 전원공급 장치 ? Oscilloscope (2채널) ? 함수 발생기
? Capacitor ? Inductor ? Transistor ? 멀티미터
3.실험 이론
■ 증폭기의 저주파 응답 특성
? 증폭기의 저주파 응답 특성
- 신호의 주파수가 낮을수록 증폭기 이득이 감소하는
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실험 / David Buchla / ITC
설계 중심의 디지털 공학실험 / 우홍체, 박철형, 남세현 / 페이퍼백
ezcmm.blog.me/110165198994 - ‘부품’관한 정보 0. 개요 (프로젝트의 목적 및 필요성)
1. 설계 이론
2. 프로젝트 일정
3. 역할 분담
4. 프로젝트 예산
5. 참
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회로에서의 전류계를 제거하고 전력계의 전류 단자를 D-E에, 전압 단자를 D-F에 연결시킨 후 ⑤의 ⑷, ⑸, ⑹의 각 실험회로에서의 유효전력을 측정한 후 표 15.4 ( b )를 완성하라.
5. 참고자료
- 기초전기전자공학실험 (교학사, 대한전자공학회, 1
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회로를 구성하고 R1 R2 V1 V2를 표 8-3에 지사한 대로 바꾸어 ab양단의 전압
{V}_{ab}
를 측정하여 기록하라.
그림 8-8
출처: 두산세계대백과 EnCyber
전기용어 대사전, 전기 기술 문화사, 김만영, 1979. 8. 25.
전기 전자 공학도를 위한 기초회로실험, 이능
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회로에서 우측 상단 다이오드를 제거하고, VO와 VR3값을 측정하라. 이 결과를 위 계산값과 비교하라.
VO (측정값) = 1.35 V
VR3 (측정값) = 2.96 V
7. 컴퓨터 실습
Pspice 모의실험 3-1
Pspice를 이용하여 아래 회로를 해석하라. 이 결과를 2(f)에서 측정한 값
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증폭기와 저항이 없는 증폭기를 설계하였다. 에미터 저항이 존재함으로 인하여 입력저항 은 만큼 증가하게 된다. 이를 통하여 입력저항을 크게 만들어 주고 싶다면 에미터 저항을 첨가하게 되면 큰 임피던스의 출력단과 연결하는 회로로써
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증폭기를 Emitter Follow라고도 부르는 이유이다. 결국 출력신호와 입력신호의 위상차는 0˚ 이다.
3. 그림 14-1의 회로에서 부하저항 RL이 커진다면 이득은?
(a) 눈에 뛰게 증가한다. (b) 눈에 뛰게 감소한다. (c) 그대로이다.
⇒ Av=Vout/Vin=[ie×RE||RL)]/{ie×
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회로, ():
주파수가 커지면 는 작아지므로 위상차가 점점 줄어들게 된다.
저역통과회로, ():
주파수가 커지면 는 커지므로 위상차가 점점 커지게 된다.
<참고문헌>
전자회로, Thomas L. Floyd, ITC, 2005
회로이론, Floyd, 광문각, 1996 실험1. RC회로
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회로 실험 / 출판사-진영사 / 저자-박건작외 3명
② 책이름디지털 전자회로 / 출판사-신화전산기획 / 저자-임광빈
③ 책이름집적회로 / 출판사-성학당 / 저자-이영준
④ 웹싸이트 - http://princess.kongju.ac.kr/
4. WINCUPL 설계 및 결과
1)전가산기 시뮬레
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1. 제목: 실험15. RL 직렬회로의 인덕턴스 측정
2. 실험결과
1) 과정(1) 인덕턴스 L 측정
≪ 그 림 ≫
Figure 15.5 - L 측정회로
Table 15.1 - L 측정회로 VA2=VR2+VL2
≪ 표 ≫
2) 과정(2) 저항(등가 인덕턴스) 측정
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