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-D 풀리풀롭은 클럭 펄스의 폭이 넓어도 출력의 변화가 없지만 래치는 클럭 펄스의 폭이 넓으면 그 동안에 입력의 변화가 출력에 나타난다. 1. 플리플롭(flip-flop)
2. 카운터(COUNTER)
3. 8진 카운터
4. 10진 카운터(counter)
5. 래치(Latch)
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플리플롭의 기본응용회로
Counter 회로
플리플롭의 가장 흔한 응용예는 카운터 회로이다. 그림5는 세 개의 플리플롭으로 이루어진 카운터 회로를 나타내고 있다. 그림의 파형에서 보다시피 각각의 플리플롭 출력을 조합은 그 시점까지 입력된 c
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연산
4-3-1 래치(latch)와 플립플롭(flip-flop)
(1) 비동기식 S-R 래치(latch)
(2) 동기식 S-R 래치와 S-R 풀리풀롭
(3) D 래치와 D 풀리풀롭
(4) J-K 풀리풀롭
(5) T 풀리풀롭
4-3-2 레지스터와 카운터
(1) 레지스터(register)
(2) 카운터(counter)
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플롭의 초기 상태는 논리 0으로 한다.
2비트 비동기 2진 카운터는 2개의 플립플롭을 사용하여 네 가지의 서로 다른 상태(00,01,10,11)를 나타내며, 10진수의 0에서 3까지 계수(counter)하고 다시 0으로 재순환 한다. 일반적인 카운터에서는
Q_A
는 최하
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8진, 10진, 16진 카운터 회로를 설계해보았다. 앞에서 보인 결과처럼 Pspice를 사용해서 비동기식 4진, 8진, 16진 카운터의 파형은 얻어낼 수 있었지만 10진 카운터는 Reset의 연결 및 설정 방법을 알 수가 없어서 파형을 얻어내지 못하였다. 또한 이
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