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0
(b)AND입력1
입력2
출력
0
0
0
0
1
0
1
0
0
1
1
1
(c)OR 입력1
입력2
출력
0
0
0
0
1
1
1
0
1
1
1
1
(d)NAND입력1
입력2
출력
0
0
1
0
1
1
1
0
1
1
1
0
(e)NOR입력1
입력2
출력
0
0
1
0
1
0
1
0
0
1
1
0
(f)Exclusive-OR입력1
입력2
출력
0
0
0
0
1
1
1
0
1
1
1
0
(2)데이터 시트에서 74LS04, 74LS08,
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게이트에 Inverter를 추가하여 입력 값이 같은경우에만
참(1)이 출력되는 게이트로 만들었음을 확인할 수 있다.
3.고찰
-이번 실험은 논리함수 개념과 gate구조의 구조 및 기능을 습득하는 실험이다.
디지털공학 시간에 이론적으로만 배운 gate회로
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N = (an-1 an-2…a0 ? a-1a-2…a-m)r = an-1rn-1 + an-2rn-2 + … a0r0 + a-1r-1 + a-2r-2 + … a-mr-m = 23page시그마기호 akrk(0≤ak 제2장 데이터 표현 제3장 부울대수와 논리게이트 제4장 부울함수의 간소화 및 구현 제5장 조합논리회로 - 출제예상문제 및 해설
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논리게이트와 부울대수 3.1 논리연산과 논리게이트 3.2 부울대수 3.3 부울함수의 정규형 및 표준형 제4장 부울함수의 간소화 및 구현 4.1 개요 4.2 카노우 도표 방법 4.3 NAND 게이트와 NOR 게이트를 이용한 구현방법 제5장 조합논리회로 5.1 개요 5.2
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표현됨
N = (an-1 an-2…a0 ․ a-1a-2…a-m)r
= an-1rn-1 + an-2rn-2 + … a0r0 + a-1r-1 + a-2r-2 + … a-mr-m
= 23page시그마기호 akrk(0≤ak<r) 제2장 데이터 표현
제3장 논리게이트와 부울대수
제4장 부울함수의 간소화 및 구현
제5장 조합논리회로
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