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볼 수 있는 디지털 시계와 비슷한 것을 설계하는 것이 그리 어렵다는 느낌이 들지 않았고 우리 일상 생활 전반에서 사용하는 간단한 전기제품을 만들 수 있을 것 같다는 자신감을 얻을 수 있었다. 1. 설계실습 내용 및 결과
2. 결론
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보인다. 실제 Kit를 사용해서 설계한 회로를 실험하여 testbench 코드가 필요 없으며 출력값이 직관적이다.
Evaluation
state를 한정한 counter를 모드에 따라서 binary로 또는 gray로 동작하도록 하는 것으로 회로의 이해가 어렵거나 코딩이 복잡하지는 않
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회로 >
< 결과 파형 >
8진 비동기 카운터 실습이 예상했던 것보다 난항을 겪어서 다른 빵판을 구해서 16진 비동기 카운터를 설계하였다. 위에서 보이는 것처럼 설계실습 계획서에서 설계했던 데로 회로를 구현하였는데, 생각보다는 많이
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R, S 입력값과 클록의 입력으로 인한 출력의 변화를 확인할 수 있었다. 또한 설계한 Edge-trggered RS 플립플롭이 Clk 신호가 High로 변화할 때에만 입력값에 따른 출력을 뽑아주는 것으로 보아 Positive Edge-triggered 임을 확인해 볼 수가 있었다.
(2) 설계
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게 소자값을 하나하나 바꿔보았는데, 금방 원하는 결과를 얻어낼 수 있었다. 약간의 운도 따라준 것 같다.
설계 실습 계획서에서 설계한 회로가 실제로 잘 구현되지 않은 것은 이상적이지 않은 각 소자들의 오차 누적과 잡음 신호 등으로 인한
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보여주셨던 빵판 설계 비법을 한 번 그대로 따라해 보았다. 그런데 실수의 확률도 적어졌고, 무엇보다도 설계한 회로를 한눈에 검토할 때 발군의 장점을 보여주었다. 앞으로는 실습 중간중간 발생할 수 있는 오차를 최대한 줄일 수 있는 방법
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수 있었다.
좀 더 직접적으로 문제를 다뤄보면, Pspice를 사용해서 설계한 엠프는 1700배의 아주 큰 이득을 얻어낼 수 있도록 설계되었는데 이를 현실로 가져와 보니 실제로 우리의 실험 환경에서는 만들어 낼 수가 없는 엠프였다. 또 하나의 큰
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획서는 잘 작성되었다고 생각하는가? 계획서에서 자신이 설계한 회로, 또는 방법이 틀렸다면 왜 틀렸다고 생각하는가? 무엇을 배웠고 무엇을 느꼈는가?
계획서에는 큰 문제가 없다고 생각한다. Pspice 상에서는 제대로 동작이 되었기 때문이다.
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보면 실험은 큰 문제없이 잘 이루어진 것처럼 보인다. 하지만 위에서도 잠깐 언급했던 것처럼 오히려 상대적인 수치가 아닌 절대적인 수치에 대해 무언가 찜찜한 느낌이 든다. 어쨌든 이번 실험은 변위에 따른 주파수의 상대적인 결과를 알아
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램프를 통해서 눈으로 확인해 볼 수 있었다. 또한 AND 게이트와 OR 게이트의 딜레이 시간을 측정해 보았는데, 이 때 하나의 게이트가 갖는 딜레이 시간이 매우 짧으므로 4개의 게이트를 직렬로 연결해서 나온 딜레이 시간을 다시 4로 나눠주는
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