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그리고 QB가 High로 출력된 구간 50~60ns에서는 Y2가 출력되었다. 마지막으로 QA와 QB가 Low인 구간 70~80ns에서는 Y0가 출력되었다.
이러한 원리로 작동한다는 것을 예비보고서를 쓸 때에는 몰랐지만 이번 실험을 통해서 알게 되었다.
1. 실험 결과
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실험으로 한번의 클럭으로 4개의 일정한 간격으로 다른 출력을 낼 수 있었다. 이것을 이용하면 일정한 시간간격으로 작동하는 무언가를 만들어 실생활에 이용할 수 있을 것 같았다. ● 4-Phase clock 발생기
●예비 실험
●결과 보고서
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4구간을 한 주기로 하는 파형이 출력됨을 알 수 있다.
와 모두 4구간을 한 주기로 하는 파형을 출력했으며, 클럭값에 따라 서로 번갈아가며 High 값을 출력하는 3상 클럭(3-Phase Clock)이다. 1. 실험 이론
2. 실험 방법
3. 문제
4. 시뮬레이션 및
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10V~+10V
- clock frequency > 10kHz
- end-of-conversion signal
- 7 segment display
- Chips available
LM311, LF356(or 741), 74LS32, 74LS00, 74LS04, 74LS08, 74LS48, 74LS74, 74LS83, 74LS95, 74LS166
실험기자재 및 부품
사용기기
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10V~+10V
- clock frequency > 10kHz
- end-of-conversion signal
- 7 segment display
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LM311, LF356(or 741), 74LS32, 74LS00, 74LS04, 74LS08, 74LS48, 74LS74, 74LS83, 74LS95, 74LS166
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사용기기
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- 오실로스코프
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