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실험을 통해 알아보았고, 앞으로 논리회로를 이용한 회로를 구성하는데 필수적인 기본 지식을 다지는 계기가 되었다.
4. 예비레포트의 가상 결선도
그림 1
그림 2
그림 3 ⒜
그림 3 ⒝
그림 4
그림 4⒝
그림 4⒞ 1. 실험 의의
2. 실험 수행 과
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회로망에서 임의의 교차점에 흘러 들어가는 모든 전류와 나가는 모든 전류의 합은 0이다’ 라는 점을 만족하는지 실험으로 확인하여 본다.
나. 키르히호프의 전압의 법칙
직렬회로를 구성한다. 각 저항의 양단에 걸리는 전압을 측정한다. 키
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실험 4장에 대한 복습문제
1. 그림 1와 같은 (+) 리미터 회로의 경우 (+) 최대전압은 대략 얼마인가?
(a) 0V (b) +0.6V (c) +3V (d) +6V
⇒ 다이오드 양단의 걸리는 전압강하의 값이 대략이 0.7V이므로 양의 반주기동안 일정한 0.7V의 값을 가지게 된다.(위에
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실험실에서 사용자의 조작미숙으로 가장 많이 고장 나는 장비가 전류측정기 또는 DMM의 전류측정부이다. 충분한 실험준비는 실험시간의 단축뿐만 아니라 장비의 고장을 줄이는 효과를 가져온다. 5V 직류전원에 10㏀ 저항이 연결된 회로에서 저
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경우의 드레인 포화전류는 라고 표시하며, , ,의 사이에서
의 관계가 성립된다. FET의 3정수인 증폭정수 μ, 드레인저항 , 상호컨덕턴스 은 다음과 같이 정의 된다.
Common Source의 경우에 대해서만 실험하며 CS에 대한 회로를 보면
<그림1. 소스공
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회로도 있다. 교류브리지는 임피던스 측정 외에도 주파수 측정 등에 많이 이용되고 있다.
5. 실험 결과
1)반파정류 출력물: 원래 아래위로 왔다갔다하던 파형이 위에서 조사한 실험관련 이론처럼 위의 부분만 올라오고 밑으로는 파형이 생기지
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전력
무효전력
(var)
유효전력
(W)
피상전력
(VA)
R-L
60
3.14
0.747
124.3
137.6
185.43
R-C
60
3.16
0.67
138.9
127.9
189.35
R-L-C
60
2.39
0.973
32.9
138
142.4
+ 실험 결과 & 고찰
위의 표 9-6은 각 회로의 전류를 측정하고, 위상각을 측정하여 역률을 구하는 것과, 전력을 측
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실험이 있는데, 양이 너무 많아, 교수님께서 지난주에 1번과 2번 실험을, 이번주에 3번, 4번, 5번 실험을 하기로 하셔서, 이번에 남은 3, 4, 5번 실험을 진행하였다.
실험을 간단히 요약하자면, 3번 실험은 커패시터를 직렬로 연결한 회로를 구성하
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회로도는 프로그램 테이블대로 프로그램 한 결과이다.
<표>프로그램 테이블
2. 실험계획
□이론 조사햇던 것을 토대로 하여서 실험 하겠다.
□PLD라는 것이 아직 확실하게 이해가 가지 않는다. DLD를 안들은것과는 상관은 없는거
같은데,
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실험준비물
(2) 전원공급기(GW GPC-3020A) 1대
(3) 오실로스코프
(4) 브레드보드(WISH 206) 1개
SN7400
SN7404
SN7408
SN7420
LTS5422R(Seven segment), Power supply, Oscilloscope
실험
(1) 다음 그림의 회로를 구성하고, 진리표를 구하여 표로부터의 논리식을 AB로 나타내어라.
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