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실험 하기에 앞서 선형회로라는 전제조건을 주는것도 있음을 확인 할 수 있었다.
참고서적 : 전기전자실험 박건작 외/진영사
디지털회로실험 김사중 외/상학당
참고사이트 : http://163.180.122.191 경희대학교 광계측연구실
tools : Pspice program
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회로도.
총 결과 회로도
74ls90 (10진 bcd 카운터)
74ls47 (7세그먼트 디코더)
17555 (VCO : 클럭 발생회로칩)
참고 : 디지털회로설계
http://www.postech.ac.kr/class/chem241/20020419/pH%20meter.htm
컴퓨터시스템구조 1.각 입력 조건에 따른 진리표.
2.7-세그먼트
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디지털회로가 혼 재할 때는 전원의 임피던스를 낮게 하지 않으면 스위칭의 영향으로 잡음이 발생한다.
마지막으로 그라운드 레벨의 처리가 문제가 된 경우 기본적으로는 1점 접지를 취하고 있으나 다수의 센서가 사용되는 경우에는 곤란하다
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논리설계에서 가장 중요한 사항임
하강지연시간(tPHL)
» 출력이 논리 1에서 논리 0으로 변화하는 데 소요되는 시간
상승지연시간 (tPLH)
» 출력이 논리 0에서 논리 1로 변화하는 데 소요되는 시간
전파지연 (tpd
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디지털회로인데 A만을 입력으로 사용하였다. 1. 실험목적
● Digital Gate의 IC를 구현하는 방법을 익힌다.
● Flip-flip을 구성하고 동작 원리를 이해한다.’
2. 실험결과
1) 실험 1 : Digital Gate (OR, AND, NOT, EX-OR Gate)
2) 실험 2 : D Flip-flo
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74LS47과 74LS90의 회로구현
옆의 회로와 같이 자신이 원하
는 숫자가 카운터될 때 AND 게
이트를 사용하여 카운터를
Reset 시켜 줄 수 있다.
10의 자리 나타내는 디코더의
입력이 0100 (4) 가 되었을 때
와 1의 자리를 나타내는 디
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회로의 실험을 하기 위하여 편리하게 쓰인다. 다음에 브레드 보드의 구조를 나타내고 있다. 일반적인 브레드 보드의 사용은 빨강색 라인을 전원으로, 검은색 라인을 공통 접지로 사용하는 경우가 많다. 1. AND GATE 실험
● 실험 목표
●
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회로의 출력을 출력하시오.
50ns의 클록의 주기를 40ns로 바꾸고 출력하시오.
회로를 작성하고 시뮬레이션 해보면 다음과 같다.
A,B 모두 0일때 x가 1이면 클록이 활성화 될 때(120ns 시점에) A는 0, B는 1로 바뀌는 사실을 알 수 있다. A는 0, B는 1일때
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te 와 Nextstate 의 경우 초기값만 0으로 설정하면 계속 오류가 발생하였습니다. 그 이유로 인해 entity 이름이 control4 로 되었습니다. 수정에 수정을 하다 보니...., 아마도 그 이유는 3을 넘어서는 신호에 대한 정의가 올바르지 않아서였던 것 같습
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회로.
위의 회로도에서 우리는 반가산기와 전가산기를 찾을 수 있다. 처음 입력은 반가산기로 들어가서 그에 대한 SUM 과 CARRY 가 출력으로 나온다. 여기서 나온 SUM 은 두 변수의 EX-OR 이다. 이 SUM이 2BIT 덧셈의 결과에서 첫째 자리이다. 그리고 CA
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