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거의 없었다. 그리고 등가회로의 저항이 부하저항보다 20배 이상 크므로 정전류원으로 볼 수 있다.
4. 참고문헌
전자통신연구회 편, 『전자통신기초실험』, 도서출판 상학당, 2009, pp74-75. 1. 노튼의 정리
2. 검토사항
3. 고찰
4. 참고문헌
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2.95
2.95
2.95
4. 실험 결과
표 25-2. 테브닌 정리를 입증하기 위한 측정
,
,
, mA
,
Measured
Calculated
Measured
Calculated
Measured
Calculated
Original
Circuit
Thevenin
Equivalent Circuit
330
4.157
4.198
1149
1093
2.9
2.9
2.95
실험 26. 노튼의 정리
1. 실험 목적
(1) 한 개 또는 두 개
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26
1.64
3.3
3.3
100
53k
0.68
1
6.8
33
33
결 과 보 고 서
실험 51. 병렬 RLC회로의 임피던스
실험 54. 병렬공진회로의 특성
분반 :
성명 :
학번 :
실험일:
실험 51. 병렬 RLC회로의 임피던스
1. 실험 결과
표 51-1. 병렬 RLC회로의 임피던스 결정
Applied Voltage V,
R
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실험목적
Ⅱ. 테브난 등가회로 실험
(1) PSpice 모의실험
(2) 실험 도구 및 장비
(3) 실습 및 결과
(4) 분석 및 고찰
Ⅲ. 노턴 등가회로 실험
(1) PSpice 모의실험
(2) 실험 도구 및 장비
(3) 실습 및 결과
(4) 분석 및 고찰
Ⅳ. 최대 전
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실험 9. 회로망 정리의 검증 (예비 레포트)
1. 실험 목적
2. 관련 이론
(1) 중첩의 정리
(2) 테브낭의 정리
(3) 노튼의 정리
(4) 밀만의 정리
(5) 상반정리
3. 예비 보고서 문제
실험 9. 회로망 정리의 검증 (결과 레포트)
3. 실 험 과 정
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