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예비실험): Multisim 사용한 모의 실험(시뮬레이션)
■ 모의실험회로 1 : 연산증폭기의 반전 증폭기 회로(시간영역)
- 모의실험 결과 그래프 및 표 :
[dB]
임계주파수
GBP
1
1.02
0.18dB
530kHz
540600
10
10.1
20.1dB
70kHz
707000
100
100.1
40dB
7.5k
750750
■ 모의실험회
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예비실험): Multisim 사용한 모의 실험(시뮬레이션)
■ 모의실험회로 1 : 연산증폭기 입력 바이어스 전류 측정
- 모의실험 결과 그래프 및 표 :
시뮬레이션 값
비반전 입력 전압
-6.862
반전 입력 전압
-9.108
■ 모의실험회로 2 : 연산증폭기의 출력
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증폭기
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-
-
-
-
(3)가산기
-
-
-
-
-
-모든 저항의 크기가 같은 경우
(4)차동증폭기
-비반전 입력 단자와 반전 입력 단자에 가해진 입력 신호의 차를 증폭하는 회로이다.
-에 의한 반전증폭기의 출력 전압 =
=>
-중첩의 원리 이용
3. 예비
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들에만 의존함을 알 수 있다. 그림 4는 비반전 전압 팔로워(follower)로 연결된 연산증폭기 회로를 보여준다. 이 회로는 그 이득이 1이기 때문에 단일 이득 증폭기(unity-gain amplifier)라고도 부른다.
※실험결과 예상 (이론값)
(1)반전 증폭기
① RF=10k
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회로를 구성하여 이론과의 결과를 비교분석하기.
※ 실험 내용
1. OP-AMP 정현파 발진기 실험
2. OP-AMP 능동 저역 통과 필터 실험
※ 실험 이론
1. OP-AMP (operational amplifier, 연산 증폭기)
- 연산을 위해서 사용할 수 있는 일종의 차동증폭기.
- 바이폴
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