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증폭기는 에서 알 수 있듯이 전압이득이 저항의 비에 +1을 해줌으로써 1:2의 저항 비에서도 3배 가까이 증폭되는 것을 확인 할 수 있다.
Op amp 는 전자회로 시간에 다룬 내용이었지만, 수업을 제대로 안 들었는지 익숙하지 않았다. 마지막 실험
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형 연산 증폭기 회로
실험 순서
1. 반전 증폭기
2. 비반전 증폭기
3. 단위이득 플로어(unity-gain follower)
4. 가산 증폭기(Summing amplifier)
5. 분석및 고찰
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증폭기의 경우 출력이 반대로 나오므로 =-7.22이다.
이미터 접지 증폭기에서 입력 저항을 측정하기 위해 을 이용하였는데 따라서 , 이다. 므로 =-7.225.103=-36.84가 나온다.
3) 실험 회로 12-1의 회로에서 커패시터 , , 에 대응하는 극점 주파수 , , 를
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증폭기의 이득에 영향을 미치는 파라미터에 대해 설명하라.
☞ : 이므로 컬렉터 전류의 값에 따라 값의 변화가 있으며
값이 커지면 전압이득은 작아지며 작아지면 이득은 커진다.
☞ : 은 보통 수백이상 이므로 개방회로로 대치
☞ : 의 영향
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증폭기마저도 엄청난 증폭값이 측정되었다. 차동증폭기도 10배정도의 증폭된 값을 보였다. 그래서 실험을 끝낸 후에 다시한번 증폭기를 새로 짜고 여러번 측정을 해보았으나 조금씩 밖에 줄어 들지를 않았다.
전자회로서적을 찾아보았으나
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