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볼 수 있고, 실험장비가 항상 완벽하지는 않다는 점을 감안한다면 이정도의 오차는 어떠한 실험에서라도 충분히 발생할 수 있는 허용범위 내의 오차라고 할 수 있겠다. 1.중첩의 원리 실험 및 분석
2.최대전력전송원리 실험 및 분석
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중첩의 정리를 이해하고 확인하는 실험이었다.
지난 시간에 회로구성에 고생한 탓에 회로구성은 쉽게 할 수 있었으나 이론값과 비교해 원리를 찾아가면서 해서인지 이번실험도 무척 오랜시간이 걸렸다.
결과 보고서를 써 가면서 새로운 것을
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↓
(단위 : mA)
전 류
I1
I2
I3
계 산 값
3.4
1.9
5.3
측 정 값
3.0
1.5
5.5
전류방향
←
→
↑
5. 검토 및 고찰
중첩의 원리를 알아보는 실험을 하였다. 단순한 저항성 회로(저항들의 직렬연결, 병렬연결, 직/병렬 연결의 조합을 포함하는 회로)의 해석을 위
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구성했으면 실험 시간을 단축 할 수 있었을 것이라고 생각했다. 회로를 구성하는 연습을 조금 더 숙달시킨다면 빠른 시간 안에 정확한 측정값을 얻을 수 있을 것이다. 그리고 이번 실험을 통해서 중첩의 원리를 확인할 수 있었다.
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중첩의 원리를 적용하는 방법에 대한 차이점을 설명하시오.
KCL은 임의의 접속점에서의 유입전류와 유출전류의 대수합은 0이라는 매우 간결한 법칙이다. KVL의 대수식 표현으로는 이다.
반면에, 다수의 전원을 포함하는 선형 회로망에서 회로
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