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(전략)
2. 요구된 5개의 블록의 베릴로그 코드
module control_single(opcode, RegDst, Jump, ALUSrc, MemtoReg, RegWrite, MemRead, MemWrite, Branch, ALUOp);
module alu(ctl, op1, op2, zero, result);
(중략)
3. 시뮬레이션 결과
R1 레지스터의 instruction 주소는 00000800. 이 값
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ARRAY[5]: 00E8082A
이진수 코드: 0000 0000 1110 1000 0000 1000 0010 1010
구조에 맞게 숫자를 나눔: 000000 00111 01000 00001 00000 101010
MIPS 코드: slt R1, R7, R8
의미 & 계산: R1 = R7 < R8 = 9 < 27 = 1
ARRAY[6]: 0107102A
이진수 코드: 0000 0001 0000 0111 0001 0000 0010 1010
구조
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목적
VHDL로 작성된 16bit myrisc processor를 참조하여 Verilog를 이용하여 설계, 구현한다.
필요성
주어진 16bit risc processor VHDL 코드를 참조하여 이번 학기 컴퓨터 구조 수업에서 배운 RISC processor과 ALU(Arithmetic Logic Unit) 등의 구조와 Pipelining등의 기술
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Verilog HDL를 활용하여 실제 시스템을 구현하는 데 필요한 기본적인 사고 방식을 익힐 수 있었고, 이는 향후 프로젝트 진행 시 큰 자산이 될 것이다. 전반적으로 Lab03은 이론과 실습을 연계하여 전자전기 컴퓨터 설계의 기초를 확고히 하는 계기
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컴퓨터 시스템의 성능을 향상시키는 데 기여하게 된다. 이러한 방식으로 간단한 컴퓨터의 제어 장치 설계는 전반적인 컴퓨터 구조의 이해와 성능 개선에 중요한 역할을 한다. 1. Verilog 및 Quartus 소프트웨어 활용 기술
2. 기본 조합 회로 설
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