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회로 내부에 기억된 상태값에 따라 출력 값이 결정.
일반적으로 가장 많이 사용되는 메모리 소자는 플립플롭이라고 하는 소자이며
가장 기본적인 플립플롭을 래치라고 한다 1. 래치
2. R-S플립플롭
3. D-플립플롭
4. JK-플립플롭
5. T-플
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회로 구성 및 출력 값.
고찰
J
K
Q [입력전의 값]
[입력후의 값]
비고
0
0
0
1
변화 없음
0
0
0
1
변화 없음
0
1
0
1
SET(=1)
0
1
0
1
SET(=1)
1
0
0
1
RESET(=0)
1
0
1
0
RESET(=0)
1
1
1
0
토글
1
1
0
1
토글
이번 시뮬레이션은 SN7479소자를 이용해 JK flip flop을 구성하는 시뮬
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회로가 잘못된 것이라고 생각하였습니다. 그래서 실험이 잘못된 원인을 찾는데도 시간이 소비되었고, led문제인 것을 알게 된 후에도 실험실에 있는 led의 개수는 한정되어 있어서, 밝게 빛나는 전구들을 찾는데도 시간이 많이 소비되었습니다
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회로를 설계하라. 단 D 플립플롭과 NAND, NOT만을 사용하여 회로를 구성하라.
(2) 실험 1에서 PRESET=0으로 놓으면 데이터는 SI로 입력되겠는가?
데이터를 쉬프트 시킬 때 PRESET은 어떤 상태로 하여야 하는가?
INPUT
OUTPUT
PRESET
CLEAR
CLK
D
Q
Q\'
0
1
X
X
1
0
1
0
X
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회로였습니다. 이 실험의 결과는 클럭 1~4일 때의 결과모습이 계속 반복되는 결과 화면을 얻을 수 있었는데, 실제로 움직이는 실험 화면을 보면 값이 움직이는 것을 더 명확하게 볼 수 있었습니다.
실험 (3)은 JK플립플롭을 이용하여 쉬프트레지
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JK플립플롭 2개와 AND게이트가 보이고 아랫줄에 조합논리 회로를 구현하기 위한 NOT, OR, AND 게이트가 보인다.
< On/Off 스위치의 모습 >
후기
저희 조는 기본적인 소자만을 사용하여 한 학기 동안 실험한 수준에서 논리회로를 구현하였고, 쉬워
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JK플립플롭으로 책과는 다르게 비동기식 10진 카운터를 설계 한 것이고, 아래의 그림은 T플립플롭으로 계수기를 설계한 것이다.
●동기 계수기
5. 다음의 상태 천이표를 가지고 JK 플립플롭(SN7476)으로 회로를 구성하고 표 14-2 와 결과를 비교하
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JK 플립플롭을 사용하여 구현하였으나, RS 플립플롭 또는 D플립플롭을 사용하여 구현할 수 있다. RS플립플롭을 사용하는 경우는 맨 오른쪽 플립플롭의 출력 Q와 Q'는 맨 위쪽의 플립플롭의 S와 R입력에 연결하면 된다. 또, D 플립플롭을 사용하는
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회로 구성 및 입·출력 값.
고찰
이번 시뮬레이션은 JK플립플롭 4비트 우 쉬프트 레지스터에 관한 시뮬레이션이다. 교재의 이론 부분에 나와 있는 입력값을 넣어보았다. 입력 X에 1011을 인가하면 그대로 1011이 출력되는 것을 확인 할 수 있었다.
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플립플롭>
1.NOR 게이트로 된 SR 플립플롭
2.NAND 게이트로된 SR플립플롭
<래치(Latch)회로>
1.D 래치
2.JK 래치
3.T 래치
<마스터-슬레이브(Master-Slave)FF>
<플립플롭 (Flip-Flop)>
1.RS 플립플롭
2.D 플립플롭
3.JK 플립플롭
4.T 플립플롭
<플립플
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