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디지털회로실험및설계 결과 보고서 #8
( Encoder, Decoder 실험 )
과 목
담당교수
제 출 일
학 번
이 름
1. 회로도
2. 실험결과 및 이론분석
실험 (1) 1.회로의 초기값에 대하여 알아보고 그 이유를 설명하시오.
2. 74LS148의 입력에 따라 FND의 출력을 확인
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회로를 구성하고 커패시터를 10[V]로 충전 후 연결선을 저항에 연결하여 [10V -> 0V]의 입력신호를 가한다. 오실로스코프는 커패시터양단의 전압 변화를 살피게 될 것이고 오실로스코프에 나타난 출력 하평을 그리고 시정수를 구하라. 이론적
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이론값들과 차이를 보였고, 이론값들을 구하는데 시간이 많이 걸렸다. 각 RLC소자에 걸리는 전압을 측정하여, ,이 성립하는지 확인하여야 했기 때문에 값들을 Phasor변환하는데도 시간을 투자하여야 했다.
일단 첫 번째 실험으로는 RLC회로에서
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회로를 연결한다.
2.함수발생기의 진동수를 100Hz에 고정시키고 인가 기전력 E를 0V부터 5V까지 1V간격으로 바꾸면서 회로의 전류를 측정한다.
3.전류와 기전력과의 관계 그래프를 그리고 기울기를 구한다. 회로의 임피던스를 이론적으로 계산하
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회로 1 : DMM을 이용한 소자 값 측정
소자
규격
측정값
저항
1k
0.9821k
2.2k
2.1749k
10k
9.827
10k
9.826
10k
9.843
22k
21.930k
100k
101.09k
캐패시터
1uF
1.13uF
1uF
0.9747uF
10uF
9.94uF
10uF
9.91uF
100uF
90.4uF
■ 실험회로 2 : BJT 공통 컬렉터 증폭기와 달링톤 회로 측정
이론 값
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회로에서 전류의 이론값은 앞에서 구한 값과 같이
가 되고, 측정값은 3.14A를 나타내었다. 그리고 전압과의 위상차는 이론값과 비슷한 41.7가 나왔다. 이를 통해 역률 이 나왔다.
R-L회로에서 소비하는 소비전력은 의 이론값이 나오고, 유효 전
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회로에서 I를 측정할 수 있으며, 만일 원 회로망에서 측정된 RL 의 IL 이 테브난 등가회로에서 측정된 전류 I와 같다면 테브난의 정리는 검증된 것이다.
<노턴의 정리>
테브냉의 정리와 유사한 이론으로 복잡한 회로망의 분석을 간단하게 하
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회로를 구성하여 이론대로 작동되는지를 확인하는 실험이다.
교제에 나오는 식처럼 전류가 분할되는 것은 확인하였으나 교제에서 원하는 전류인 =8.4mA, =4.2mA 를 만들지 못하였다. 교제에서 제시한 전류를 만들기 위해선 저항을 1.2 짜리 저항
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회로에서는 이상적인 이론값이 가변저항을 지난 후 위의 식(
{V _{o}} over {V _{i}} + {R _{2}} over {R _{1}} =0
)을 만족하여야 하나 그렇지 못한 것은
R _{2}
, 즉 회로의 뒷부분 쪽으로 갈수록 저항이 상대적으로 증가하여 오차가 발생한다고 생각할 수
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회로도 (채터링 방지 회로도)
이론값
※ RUN 직후 ※
- J1 = VCC J2 = VCC 일땐 U1은 9 U2은 9
- J1 = 그라운드 J2 = 그라운드 일땐 U1은 0 U2은 0
- J1 = VCC J2 = 그라운드 일땐 U1은 0 U2은 0
- J1 = 그라운드 J2 = VCC 일땐 U1은 9 U2은 0
※ RUN 후 스위치 이동시 ※
- J1
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