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디지털공학실험 / 이병기 / 喜重堂 / 1992. 2. 25 / p.67 ~ p.78
③ 디지털 시스템 / 송상훈 외7명 / 인터비젼 / 2005. 3. 28 / p.473~ p.476
④ http://blog.naer.com/dbskffl?Redirect=Log&logNo=140010178842
⑤ http://blog.naver.com/nanyokitty?Redirect=Log&logNo=140028874871 1. 목적
2.
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카운터 출력상태>
클록 펄스 인가 수
C
B
A
클리어(CLR)
0
0
0
1
0
0
1
2
0
1
0
3
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1
1
4
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0
5
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5. 참고자료
① TTL응용 실무 / Don Lancaster / 한국과학원 / 1977. 6. 30 / p.37 ~ p.119
② 디지털공학실험 / 이병기 / 喜重堂 / 1992. 2. 25 / p.79 ~ p.92
③ 디지털 시스
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카운터 출력상태
CP인가 수
Q4
Q3
Q2
Q1
CLR
0
0
0
0
1
0
0
0
1
2
0
0
1
1
3
0
1
1
1
4
1
1
1
1
5
1
1
1
0
6
1
1
0
0
7
1
0
0
0
8
0
0
0
0
9
0
0
0
1
10
0
0
1
1
11
0
1
1
1
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1
1
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1
5. 참고자료
① TTL응용 실무 / Don Lancaster / 한국과학원 / 1977. 6. 30 / p.37 ~ p.119
② 디지털공학실험 / 이병
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실험 16 결합형 카운터
[서 적] 디지털 공학 실험, 임해진 정도영 외 4명, 두양사, 2006년,
20장 링 시프트 카운터와 존슨 시프트 카운터
[사 이 트] 공주대학교 가상강의실 : http://princess.kongju.ac.kr/
-- 이론적 설명 부분 참조 (회로도 및 그림 부분)
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회로를 구성한다
(5)Clear 입력에 0->1로 하여 Q1Q2=00으로 만든다.
(6)클록입력에 펄스를 주어서 Q1Q2의 상태표를 기록한다.
5.Reference
디지털 회로 실험 <한양대학교>
디지털 논리 회로 <John M. Yarbrough> 1.제목
2.실험 목적
3.관련
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