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설계하였던 Logic_unit block, Arithmetic_unit block, Mux, block, Shifter block으로 이루어져 있음을 확인 할 수 있습니다. 입력으로는 8bit의 A, B 신호와 연산의 종류를 선택하게 되는 5bit의 sel 신호, 그리고 Carry in을 나타내는 1bit의 C_int신호가 있고, 출력으로
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half word to
word) unsigned>
<op=15(flag set)>
<op=16(move byte)>
<op=17(move half word)>
실제로 결과값을 살펴보면
모든 연산이 정확함을
확인할 수 있다. ① Arithmetic Logical Unit의 시뮬레이션 결과
① Arithmetic Logical Unit의 설계
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logic이 완성된다.
다음은 두 번째 combinational logic이다. 이는 32bit 16to1 MUX만으로 간단하게 설계된다.
각 register에서 출력된 결과값들을 불러오는 과정이다. read port의 번호를 결정하는 'radd2'가 이
MUX의 select bit이 된다. 여기서 선택된 값을 read port
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대한 rdy_x와 read에 대한 rdy_x를 AND게이트로 연결하면, 최종 output rdy_x가 출력된다.
시뮬레이션 결과는 첫 페이지에 나타내었다. 시뮬레이션 결과가 정확함을 확인할 수 있다. ① Memory Controller의 시뮬레이션 결과
① Memory Controller의 설계
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sign값이 1인, arithmetic shift의 결과값이다. right shift가 이루어진 후, MSB에 1이 추가된 것을 알 수 있다. 실험 ① 128 to 4 MUX의 시뮬레이션 결과
실험 ② Logical Unit들의 시뮬레이션 결과
실험 ① 128 to 4 MUX의 설계
실험 ② Logical Unit들의 설계
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회로 설계의 문제인지 등의 원인 발견을 위해 실제 실험을 진행하며 비교, 검토가 필요하다.
실험방법
<실험 부품 및 장비>
전원 : 독립적으로 가변할 수 있는 직류 정전압원 2대
장비 : 디지털 멀티미터, 0~10mA 직류 밀리 전류계 또는 VOM
저
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), 7476(JK F/F), 7448(Decoder)
저항 : RS래치용(5K, 3.9K), 발진(47K * 2), 스피커 출력(1K)
커패시터 : 발진(1uF), 리셋스위치용(33u)
세그먼트, 스피커, 스위치
전체회로도 ․ 동작설명
․ 부분별 설계과정
․ 부품목록
․ 전체 회로도
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설계하는 작업도 병행하였다.
PSPICE란 간단한 회로도를 작성하고 시뮬레이션 작업을 통해서 그 회로도를 분석하고 파악 할 수 있는 프로그램이다. 처음 사용하는 프로그램이라 어려운 점도 많았지만, 아직은 단순한 회로만 설계하는 작업 이
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디지털 시계 전체 회로에서 분 조절 스위치와 시 조절 스위치 한쪽이 10Hz에 연결 되어 있는 것을 1Hz의 연결로 바꾸어 분과 시를 하나씩 조절 할 수 있도록 보안하였다. ▣ 설계 목적
▣ 설계 이론
▶동기식 modulo-N 카운터
▶시간을 표시
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목적
CS 증폭기와 Cascode 증폭기를 설계하고 이를 측정하여 동작 특성, 이득 및 위상 관계에 관해 알아바고, 두 증폭기의 차이점에 대하여 비교한다.
실습준비물
FET : IRF540 2개
저항
커패시터
오실로스코프 (Oscilloscope) : 1개
브레드보드 (Bread
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