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a)에 기록한다.
(11) 회로도 (i)대신 7476 JK flip-flop을 사용하여 절차 (10)을 반복하고 표 7(b)에 기록한다. 디지털공학실험 플립플랩 예비보고서
1.실험제목
2.목적
3.이론
(1) 기본 RS 플립플롭
(2) RS 플립플롭
(3) PR/CLR RS 플립플롭
(4) D 플
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에 LOW가
나오게 된다. T 플립플롭은 입력된 값이 연속적으로 토글(toggle)되면서 출력
값이 계속해서 HIGH 와 LOW를 반복하게 된다.
(6) JK 플립플롭이 그림 7의 진리표와 같이 동작함을 확인하고, PR/CLR JK 플립
플롭의 회로를 그려라.
JK 플립플롭은
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러스 15카운터 회로를 구성하라.
modulus n 카운터 의 작동
5 MODULUS COUNTER의 작동
J0=KO=Q'3
J1=K1=Q0
J2=Q1Q0 K2=Q2
(4) 모듈러스 13 카운터 회로를 구성하라.
13진 카운터
<참고 문헌>
- 디지털 논리 회로 분석과 설계 p 481 ~
- 디지털 공학 실험
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해 보니 전혀 그렇지가 않았다.
Reference
참고도서
(디지털 논리와)컴퓨터설계 Mano, M. Morris 교보문고
(공학도를 위한 알기쉬운)디지털공학 이재수 한올
(디지털)논리 회로설계 이상부 정일
인터넷 사이트 1. JK 플립플롭
2. T 플립플롭
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ttp://idec.kwangwoon.ac.kr/openlec/year99/july/070813_5/tsld125.htm 실험 결과
실험1.
실험분석
실험2
회로도
시뮬레이션
실험분석
실험3
회로도
시뮬레이션
결과 사진
결론
실험4
회로도
시뮬레이션
실험결과
실험 진리표
실험 3과의 비교
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