|
회로가 와이어드 OR 형태로 표현되었다. 그림 3.3은 와이어드 OR 회로이다.
2.3상태 TTL 버퍼/인버터
그림 3.4는 3상태 인버터의 동작을 설명한다. 출력단의 스위치가 ON일 때 정상적인 인버터의 동작이지만 스위ㅣ가 OFF일 EO는 플로팅되어 인버터의
|
- 페이지 4페이지
- 가격 500원
- 등록일 2010.04.30
- 파일종류 한글(hwp)
- 참고문헌 없음
- 최근 2주 판매 이력 없음
|
|
회로를 전가산기회로라 한다. 만약 A=011과 B=101을 더하는 경우를 생각해보자.
n-1번째 다리에서 발생한 자리올림수 (Cn-1)1과 A(1), B(0)의 세 수가 합해져 합 Sn은 0이 되고 다시 이 자리에서 자리올림수 (Cn)1이 발생되어 다음 자리 (n+1)에 합해주어야
|
- 페이지 4페이지
- 가격 700원
- 등록일 2010.04.30
- 파일종류 한글(hwp)
- 참고문헌 없음
- 최근 2주 판매 이력 없음
|
|
게이트 회로에서 저항값은 R1은 4kΩ, R2는 1.6kΩ, R3는 2kΩ, R4는 5kΩ 정도가 된다.
TTL 게이트에서는 입력의 수를 늘리려면 입력 트랜지스터의 이미터 수를 늘리면 된다.
(a) 입력에 저전압 공급
(b) 입력에 고전압 공급
[그림] 표준 TTL NAND 게이트 동
|
- 페이지 5페이지
- 가격 900원
- 등록일 2004.09.11
- 파일종류 한글(hwp)
- 참고문헌 있음
- 최근 2주 판매 이력 없음
|
|
TTL 게이트 군에서 사용된다. 토템-폴 출력TTL 에서의 Q2의 이미터 저항이 schottky TTL에서는 트랜지스터 Q6와 2개의 저항으로 구성된 회로로 대신 되었다. 이 회로는 앞에서 논의되었던 차단전류의 스파이크를 감소시키기 위한 것이다. 전파시간을
|
- 페이지 6페이지
- 가격 1,800원
- 등록일 2013.05.16
- 파일종류 한글(hwp)
- 참고문헌 있음
- 최근 2주 판매 이력 없음
|
|
게이트
입력
출력
A
B
X
0V
0V
0V
0V
5V
5V
5V
0V
5V
5V
5V
0V
XOR 게이트 진리표
XOR 게이트 진리표
XOR 게이트는 OR 게이트와 출력이 반대되는 게이트로써, 이번 회로는 3개의 XOR 게이트를 연결하여 구성하였다.
입력이 모두 5V일 때, 출력은 0V를 나타냈고,
|
- 페이지 5페이지
- 가격 1,300원
- 등록일 2013.12.06
- 파일종류 한글(hwp)
- 참고문헌 있음
- 최근 2주 판매 이력 없음
|