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높아지면 전류가 잘 통과해서 전압 이득이 높아진다. 저역 통과회로는 고역 통과회로와는 반대로 주파수가 낮을 때 전류가 잘 흘러서 전압 이득이 커지게 된다.
결과보고서
<2008 일반전자 공학 실험>
-연산증폭기-
강남준 조교님 반
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전압은 증폭돼서 나왔다. 실험 도구의 정확성이 부족한 점과 우연오차 등이 있어서 오차가 나온 것 같다.
두 번째 실험은 Bode Analyzer로 연산 증폭기의 주파수에 따른 전압 이득과 위상차를 보는 실험이었다. 실험 결과는 굴곡이 많지만 대체로
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연산증폭기에서 슬루율은 무엇을 제한하는가?
(a) 입력임피던스(b) 동상신호제거비(c) 전압이득(d) 주파수응답
⇒ 연산증폭기에서 슬루율을 측정할시 증폭기의 폐회로이득이 1인상태에서 측정해야 하므로 결국 전압이득을 제한하는 것이다.
5.
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결과 실험을 통해서 반전 증폭기의 주파수 특성을 알게되었다. 멀티심을 통해 이론적인 값과 근접하게 측정한 뒤 실제 실험에서 엘비스를 이용하여 결과값을 도출해냈다. 실제 실험에서 이론과 비슷한 값을 찾아내었고, 보드선도를 통해 LN741
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는 두 신호를 연산증폭기내에서 비교하여 두 신호 중 어느 것이 큰지에 따라 출력신호를 달리내는 회로를 비교기라고 한다. 비교기에 사용되는 입력신호는 한 개를 사용할 수 있고 두 개를 다 사용할 수도 있다. 두 개를 다 사용한다는 것은
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