|
RC 회로
키르히호프의 정리에 의해 전원장치의 기전력 V, 저항에서의 전압강하 VR , 축전기에서의 전압강하 VC 사이에는 다음과 같은 관계가 성립한다.
이 때, ti, Qi는 각각 처음 시각과 그때에 축전기에 들어있던 전하량이다. 처음 시각
|
|
|
PSpice 모의실험 - CH.5 FET 바이어스 회로 및 FET증폭기
PSpice를 통해 주어진 회로를 구성하여 시간 영역(과도)해석을 수행하라. 또한, 회로의 schematic 및 입력전압(), 출력전압()의 파형을 해당 표에 포함하여 시뮬레이션 결과의 적절성을 보여라. 의
|
|
|
PSpice 모의실험 - CH.8 차동 증폭기 회로
PSpice를 통해 주어진 회로를 구성하여 시간 영역(과도)해석을 수행하라. 또한, 회로의 Schematic과 차동모드(Differential-mode)와 동상모드(Comnon-mode)에서 각각 입력-출력전압들(vi+, vi-, vo1, vo2)의 파형을 해당 표
|
|
|
회로 P-spice 시뮬레이션 수행 결과
회로도 )
조건 ) Start Freq :1kHz , End : 2000kHz , Points : 10001
시뮬레이션 결과 )
# log scale로 변환하지 않은 값
# x 축 log scale로 변환한 값
시뮬레이션 . 고주파 증폭 회로 실험 시뮬레이션 결과
회로도 )
조건 ) R8 : 1000k,
|
|
|
.
3. 브리지 정류와 평활회로 시뮬레이션 수행결과
1. 브리지 전파 정류 회로 시뮬레이션 결과
2. 브리지 평활 회로 시뮬레이션 결과 1. 실험 목적
2. 관련 이론
3. 브리지 정류와 평활회로 시뮬레이션 수행결과
4. 시뮬레이션 결과
|
|
|
→ +100uA
IB가 100uA일 때 IC가 2mA라 가정하면…
컬렉터 전류 : 2mA → 3mA → 2mA → 1mA → 2mA
VC = VCC - VRL
VRL = ICRL
* 바이어스 방법과 안정화
*이미터 바이패스 캐패시터
* 위상관계
3) 시뮬레이션 결과 1)실험 목적
2)관련 이론
3)시뮬레이션 결과
|
|
|
8. 1번, 2번 전원을 더한 파형을 관찰하고 기록하시오.
더한 파형을 보면 7번에서 나온 두 개의 파형을 ADD하는 것으로써 나타내는데 이것은 양의 부분은 양의 부분으로 증폭되고 음의 부분은 음의 부분으로 증폭되서 새로운 파형이 발생하
|
|
|
Coupling 으로 설정하여야 출력을 확인할 수 있습니다
3. 가산 증폭기 P-spice 시뮬레이션 수행 결과
회로도 -
시뮬레이션 결과 값: Run to Time :50us 1. 실험 목적
2. 관련 이론
3. 가산 증폭기 P-spice 시뮬레이션 수행 결과
4. 시뮬레이션 결과
|
|
|
이유를 생각해
보자.
⑦ 저항과을 값을 달리하여 실험을 하고 각각의 입력파형과 출력파형을
그리고 전압이득을 구해본다.
● 비반전증폭기
① OP amp의 작동을 위해서 OP amp 에와를 걸어준다.
② 그림13-7의 반전증폭기 실험회로와 같이 비반전
|
|
|
실험을 반복하라.
Ra(V) = 5V, Rb(V) = 5V
B-1. 10㏀ 저항들을 사용하여 실험을 반복하라.
Ra(V) = 5V, Rb(V) = 5V
2. 전류측정
목적 : 노튼회로를 구성하여 보고 측정해본 후 이론값과 비교하여 본다.
다음과 같은 회로를 구성하라.
+
10V
-
A. 전원의 전압이
|
|
메뉴펼치기
