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Coupling 으로 설정하여야 출력을 확인할 수 있습니다
3. 가산 증폭기 P-spice 시뮬레이션 수행 결과
회로도 -
시뮬레이션 결과 값: Run to Time :50us 1. 실험 목적
2. 관련 이론
3. 가산 증폭기 P-spice 시뮬레이션 수행 결과
4. 시뮬레이션 결과
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예비 보고서
가산기 및 혼합기
날 짜
11/12
학 과
전자전기공학부
학 번
A515146
이 름
유재욱
실 험 조
1조
실험조원
이효문
1.제목
가산기 및 혼합기
2.목적
연산증폭기를 사 (1)예비보고서
1.제목
2.목적
3.관련이론
4.실험 준비 결과값 예
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같은출력을 얻는다.
그림 4. 비반전 회로
참고문헌 ; 전자회로공학 / p633~651
기초전자회로실험 / 연산증폭기편 1.op-amp의 개관
2.동작의 개요
3.op-amp 이득
4.입력/출력 극성
5.공급전압
6.기본적 차동증폭기
7. 반전 증폭
8.비반전 증폭
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가산기로서의 연산증폭기
-(10/10x5 + 10/10x5) = -10V
위의 이론값들에서 약간의 오차가 나게 결과값이 나올 것으로 예상된다.
3. 참고문헌
- 전기 전자 개론 (광명)
- 일반 전자 공학 (삼원출판)
- 전기 공학 (학문사) ※실험제목 : OP-AMP(연산 증폭
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가산 증폭기)
Vi4, Vo4
Reference
[Fundamentals of Microelectronics]
B.Razavi 저 | John Wiley 2nd Edition
[전자회로실험]
이현규, 김영석 저 | 충북대학교출판부
[FLOYD 기초회로실험 제9판 - 원리와 응용]
David M. Buchla 저 | 도서출판 ITC
[전기 전자 통신공학도를 위한
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