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실험의 이론적 결과
(1) 예비보고서
(1) 전가산기(full adder)에 대해 설명하라.
아래 그림과 같이 2개의 비트 A, B와 밑자리로부터의 자리올림 Ci 을 더해 합 S와 윗자리
로의 자리올림 Co를 출력하는 조합회로이다
(2) ALU의 기능에 대해 설명하라.
①
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기초 전자전기공학실험, 홍릉과학출판사
http://dyon.postech.ac.kr/Edulab/gen-phy2/exp9/exp9.html
http://user.chollian.net/~jackcom/study/hw/diode.htm
http://www.eungok.hs.kr/99/5/sil4.htm
http://asan3.sch.ac.kr/~bslee/lecture/전자회로1
http://heebok.kongju.ac.kr/experiment/electron/em12.html
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2V/V 이상의 전압 이득을 갖는 차동 증폭 회로를 설계하시오.
- 실험을 시작하기 앞서서 사용할 저항들의 실제 측정값들을 멀티미터를 통해서 측정해보았다.
그 모습은 다음과 같았다. 1. 실험 과정 및 결과
2. 실험 결론 및 분석●고찰
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실험데이터를 측정하여 확인하고자 하는 내용을 추려낼 수 있는 능력. 아직 부족하지만 더욱 노력하여 보다 정확하게 보다 빠르게 기초전자물리학실험을 수행할 수 있는 ‘나’를 만들어야겠다. 1. 실험 목표
2. 실험 배경 요약(교재와 참
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회로에서 충분히 실험을 통해 증명할 수 있다.
실험결과 분석 및 토의
●이번 실험은 정상상태의 직류 회로망에서 의 작용과 에 걸리는 전압이 지수함수로 증가함을 실험을 통해 직접 확인해보았고, 또 직렬 및 병렬 연결된 의 전체 용량에 관
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실험 종합
이번 실험은 CMOS 회로의 전기적 특성을 알아보는 시간이었다. 3년 만에 만지는 오실로스코프에 긴장하기도 하였지만, 예비보고서를 준비할 때 오실로스코프에 대한 조사를 하고가니 한결 쉽게 해결 할 수 있었다. 실험1번에서 미세
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=Xc)
CT(실험값)
CT(이론값)
LCR미터 측정값
3) RC 직렬회로의 특성
캐패
시터
Xc
(계산)
VR
VC
I[mA]
Z
(이론값)
Z
(실험값)
Vs
0.47uF
0.22uF
5. PSpice 시뮬레이션 예비보고서
1. 실험의 목적
2. 실험을 위한 기초 이론
3. 실험방법
4. P-spice 시뮬레이션
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수 있다.
▶ 입력전류(위) 출력전류(아래)의 시뮬레이션이다. 입력은 약 25uA 의 크기를 가지고 출력은 약 800uA의 크기를 가진다. 약 30의 전류이득이 있는 것을 볼 수 있다. 1. 목적
2. 기초이론
3. 실험방법
4. 예상결론 및 Pspice Simulation
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모든 합성 임피던스 값으로 나눈 전체 전류가 각 소자에 흘러들어간다.
3 참고문헌
전자통신연구회 편, 『전자통신기초실험』, 도서출판 상학당, 2009, pp96-97.
AlexanderSadiku, 『Fundamentals of Electric circuits』4th, McGRAW.hill higher Education, 2009, pp387-390.&nbs
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는 어드미턴스에서 서셉턴스 성분이 0이 되는 주파수를 말한다.
따라서 공진 시 화살표 왼쪽 부분은 폐루프 형성되므로 저항은 5.2k 으로 생각할 수 있다. 오른쪽 부분의 저항은 매우 작기 때문에 무시가능.
즉,,
,
공진 주파수에서의 와 와 을
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