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구한것과 같이, 매우 작은 출력저항이 나오게 된다. 컬렉터 접지증폭기는 입력전압과 출력전압이 동일하고, 입력저항은 크며, 출력저항은 작기 때문에, 출력버퍼로 이용된다. 출력버퍼는 회로와 회로가 연결되는 부분에서 서로의 간섭을 최
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이득
% 에러
RL = 100Ω
1.18V
1.12V
0.949
0.968
1.96%
RL = 1KΩ
1.08V
1.04V
0.962
0.994
3.21%
RL = 10KΩ
1.18V
1.18V
1
0.996
0.4%
④ 조건1. R1 open 일 경우
⑤ 조건2. R2 open일 경우
⑥ 조건3. R1 shorted일 경우
⑦ 조건4. RE open일 경우
⑧ 조건5. open collector 일 경우
※ 실험 결
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흐르지 않게 된다.
④ 공통 드레인 증폭기 회로의 전력이득은 왜 낮은가?
전압 이득과 입력 임피던스가 낮기 때문에 당연히 전력이득이 낮아지게 된다.
연습문제
① 그림 18-7에서 일 때 양단전압 를 계산하여라.
※ 종합 검토 및 논의
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실험 결과 (시뮬레이션)
PSpice 모의실험 - Ch.3 BJT의 고정 및 전압분배 바이어스
PSpice를 통해 주어진 회로를 구성하여 트랜지스터의 β 값을 계산하라. 또한, 회로의 schematic 및 VB, VE, IE, IC, VC, IB 를 확인하고 해당 표에 포함하여 시뮬레이션 결과
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및 결과
• 저항계를 사용한 바이폴라 트랜지스터의 단자 확인
E1.1 디바이스 전류의 안정화(npn)
E1.2 접합 관리와 접합 전류 확인
E2.1 베이스-전류 바이어스
E2.2 베이스-에미터 고정전압 바이어싱
• 증폭기로서의 BJT
E3.1 전압 이득과
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