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대수로 증명하라.
X=A(A+B)+C ⇒ (분배법칙) ⇒ X=AA+AB+C
⇒ (부울법칙 7. AA=A) ⇒ X=A+AB+C
⇒ (부울법칙 10. A+AB=A) ⇒ X=A+C
즉, X=A(A+B)+C는 X=A+C와 등가이다.
2. NOR 게이트로 문제 1의 논리를 구현 하는 방법을 보여라.
문제 1의 논리는 X=A+C이고 OR게이트에 A
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시퀀스를 뛰어넘어서 구현되었다. 회로를 다시 확인해보고 소자도 바꾸어 보고 핀번호도 하나하나 확인해 보았지만 정상작동 되지 않앗다. 그래서 조교님의 입회하에 회로가 완성되었고, 정확한 실험과 정확한 결과를 볼 수 있었다. 마지막
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1
0100
0
0101
0
0110
1
0111
0
1000
0
1001
1
1010
X
1011
X
1100
X
1101
X
1110
X
1111
X
BA
DC
00
01
11
10
00
0
0
1
0
01
0
0
0
1
11
X
X
X
X
10
0
1
X
X
그림 8-6 3으로 나누어 떨어지는 BCD수에 대한 Karnaugh맵
맵으로부터 읽은 최소 SOP : X=AD+ABC+ABC
AD
ABC
ABC
회로도
표 8-5의 실험결과
3 = 00
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및 XOR 게이트의 논리 기능>
1. 부록 A에서 7432 quad 2-입력 OR 게이트와 7486 quad 2-입력 XOR 게이트의 연결 다이어그램을 찾아 보라. 이들 IC 각각에는 4개의 게이트들이 포함되어 있다. Vcc와 접지를 해당 핀에 연결하라. 보고서의 표 5-2에 주어진 대
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연결 해야 하는데 연결을 하면서도 합선 이라던가, 잘못된 핀번호에 꽂기 등 몇가지의 이유로 실험의 결과값이 제대로 나오지 않아 다시 실험을 하게 되어 시간이 지체 되었다.
2진/Excess-3코드 변환 회로를 구성하는 과정에서는 C0를 접지에 연
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○ 실험 목표
○ 사용 부품
○ 관련 이론
○ 실험 순서
○ 심층 탐구
○ 모의실험&실험예측(PSPICE Simulation)
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대해서 트리거할 수도 있다. DSO(디지털 저장 오실로스코프)는 트리거 전의 신호를 보여줄 수 있기 때문이다. 트리거 메뉴에서 CH2 트리거링을 선택하고 SET LEVEL TO 50%를 선택하라. 그리고 sweep speed를 5ns/div까지 올려라 tPLH나 tPHL을 관찰하기 위해
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대한 제작자 데이터 시트에서 최대치를 조사한 후에 회로를 설계하고 구성하라. 디스플레이로는 LED 1개와 전류 제한용으로 저항 330Ω을 사용하라. 펄스폭이 설계 내용과 대략 같은지를 검사하라. 보고서에 회로를 그려 넣고 실험 결과를 기술
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2, M3, M4)을 ‘작동요구사항’에 주어진 규칙에 따르는 4개의 스위치(S1, S2, S3, S4)로 제어하는 논리를 설계하고 회로를 구성하여 바르게 작동하는지 테스트해보았다. 처음에 우리는 회로를 최대한 단순화 하지 않고 그대로 구성하여 회로가 복
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대치될 수 있고, 이러한 변경은 1개의 IC로 회로를 구현할 수 있게 한다. OR 게이트를 3개의 NAND 게이트로 대치하여 그림 8-5의 회로를 변경하고 보고서에 제공된 여백에 새로운 회로를 그려라.
6. 실험순서 5의 회로를 구성하라. 입력의 모든 조합
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