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결 과 보 고 서
실험 23. 평형 브리지 회로
실험 24. 중첩의 원리
제목 : 실험 23. 평형 브리지 회로
1. 실험 목적
(1) 평형 브리지 회로의 저항기들 사이의 관계를 구한다.
(2) 평형 브리지 회로의 저항기들 사이의 관계를 이용하여 미지의 저항을 측
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결 과 보 고 서
실험 46. 교류회로의 소비전력
실험 50. 병렬 RL 및 RC회로의 임피던스
실험 46. 교류회로의 소비전력
1. 실험 목적
(1) 교류회로에서 실제전력과 가상전력을 구별한다.
(2) 교류회로에서 전력을 측정한다.
2. 실험과정 Pspice로 구현
전
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예 비 보 고 서
실험 46. 교류회로의 소비전력
실험 50. 병렬 RL 및 RC회로의 임피던스
실험 46. 교류회로의 소비전력
1. 실험 목적
(1) 교류회로에서 실제전력과 가상전력을 구별한다.
(2) 교류회로에서 전력을 측정한다.
2. 관련이론
◈ 교류회로의
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결 과 보 고 서
실험 51. 병렬 RLC회로의 임피던스
실험 54. 병렬공진회로의 특성
실험 51. 병렬 RLC회로의 임피던스
1. 실험 목적
(1) R, L, C가 병렬 연결된 회로의 임피던스를 실험적으로 결정한다.
2. 실험과정 Pspice로 구현
인덕터 전류=1.59mA
13.8mA
=
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회로에서 주파수에 반비례하므로 전류는 주파수에 비례한다. 즉 인덕터와 성질이 반대다. 즉, 인덕터에서는 전압의 위상이 전류를 앞서지만, 캐패서터에서는 전류의 위상이 전압을 앞선다.
3. 실험 준비물
기기
■ DMM
■ 함수발생기
저항( 1/2-W
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예 비 보 고 서
실험 51. 병렬 RLC회로의 임피던스
실험 54. 병렬공진회로의 특성
실험 51. 병렬 RLC회로의 임피던스
1. 실험 목적
(1) R, L, C가 병렬 연결된 회로의 임피던스를 실험적으로 결정한다.
2. 관련이론
앞 실험에서 설명한 이론과 크게 틀
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회로에 주로 사용한다.
- 내부구조
- 진리표
CK
D
Qn+1
비고
0
X
Qn
불변
1
0
Qn
불변
1
1
n
반전
- 타이밍도 1. 그림 8의 4-bit even-parity generator/checker 실험회로를 결선하시오. D0, 1, 2, 3 입력에 1=H(5V) 와 0=L(0V)의 조합을 인가하고 Switch SW의 ON/OFF 상태에
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이 회로의 첫 stage인 op amp에서 증폭되는 정도를 적절하게 설계해야 BJT가 감당할 수 있는 최대 입력을 넘지 않는다.
R2에 10K 가변저항을 달아서 증폭률을 변경한다. 개요
SPICE Simulation
설계 과정 및 결과
고찰
Q&A
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3) 테브닌 등가회로
① 등가 회로로 고치려고 하는 회로를 본래의 회로망으로부터 떼어 낸다.
② 개방 회로 전압 를 구한다.
③ 회로에 존재하는 모든 독립 전원들을 제거한 다음, 단자에서 회로 쪽으로 들여다본 저항, 즉 를 구한다.
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. 즉 접합점을 향해 들어가는 전류의 합과 나오는 전류의 합은 항상 같다.
*제2법칙 - 전압의 법칙
회로에서 가해진 전원전압은 저항3개로 나누어져 소비된다. 즉, 부하는 3개의 저항이 되고 각 저항마다 전압강하가 생길 것이다. 각 저항의 전
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