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증폭기에서 일반적으로 요구되는 성능이며 입력 단자에 전류가 들어가거나 나가지 않는다) 출력 임피던스 Zo 는 0 (증폭기에서 일반적으로 요구되는) 차동 증폭 회로 구성으로 되어 있다.(반전 ,비반전의 두 개의 입력 핀을 가지고 있다) 차동
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증폭기(OP-AMP)의 구성
● 연산증폭기는 차동증폭기, 전압증폭기, 출력증폭기 회로의 조합으로 구성된다.
● 두 개의 입력단자와 하나의 출력단자가 있다.
● 두 개의 입력단자 중 하나는 반전입력(Inverting Input)이고 다른 하나는 비반전
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회로판, 전선, 파워 서플라이 (입력전압 2개짜리)
실험방법
① 회로판에 OP-AMP 회로를 구성한다.
여기서 이번 실험은 반전증폭기회로와 비반전증폭기회로를 구성한 다.
② 파워서플라이에서 입력전압을 맞추고 OP-AMP 회로에 입력전압을 걸 어준
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이유를 생각해
보자.
⑦ 저항과을 값을 달리하여 실험을 하고 각각의 입력파형과 출력파형을
그리고 전압이득을 구해본다.
● 비반전증폭기
① OP amp의 작동을 위해서 OP amp 에와를 걸어준다.
② 그림13-7의 반전증폭기 실험회로와 같이 비반전
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회로에 전류가 흐른다.
결과
○ 실험에 쓰여진 분압기 와 op-amp
R1
Vin
Vout
R2
Vin = Vout
분압기(입력전압)
8
7
6
5
-
+
○
1
2
3
4
IC회로(op-amp)
(1) inverting (반전증폭기)
RR
RF
+
-
Vout
+
-
1-1) AC ; inverting
Vin
RR
RF
Vout
계산값
1.2㎷
1 ㏀
2 ㏀
2.4㎷
측정값
1.2㎷
〃
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