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실험에서 살펴본 것은 차동 증폭기의 가장 단순한 형태이다. 실제로는 이 회로로부터 조금씩 변화를 주어 차동 증폭기의 특성을 향상시켜 사용한다. 위 실험의 결과와 전자회로 강의의 내용을 바탕으로 위 실험의 차동 증폭기를 변형시킨 구
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차동 증폭기
2. PSPICE Simulation
1) 실험1
실험 회로도
시뮬레이션 결과
분석 : Rref를 조절해 가면서 Iref가 20mA가 되도록 하는 저항값을 찾아보았다. 그 결과 저항값이 177Ω일 때 Iref=20.04mA가 되어 적합한 저항값을 얻었다. 이것을 통하여 Vx를 주어진
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실험2
VC1
VC2
VE
VEE
VB1
VB2
4.9V
4.9V
-0.5V
-9V
-6.3mV
-6.3mV
1) 단일입력회로
단일입력 회로도
단일입력 Vout1,2
단일입력 Ve
단일입력 Q2 Vout 1,2
단일입력 Q2 Ve
차동입력 회로도
차동입력 입력신호
분석 : 단일입력 차동증폭기에서는 Q1, Q2가 같은 형태로 나
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전자회로 11판, Robert L. Boylestad, Louis Nashelsky 지음, PEARSON
http://ko.wikipedia.org/wiki/차동증폭기
http://terms.naver.com/entry.nhn?docId=595958&mobile&categoryId=339
http://asic.postech.ac.kr/3.Class/1.Classes/05_332/exp10.pdf 제목
실험 목적
실험 장비
이론(PSpice 포함)
출처
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VD2 = 3.966 V
VbG = 2.453 V
VG1 = 3.001 V
VG2 = 3.001 V
VS = 0.657 V
IREF = 20.04 mA
ISS = 20.04 mA
를 인가해 주고 주어진 노드의 파형의 진폭은 다음과 같다. ,진폭 49.5mV , 진폭 380mV 25.9mV, 전압이득 : 380mV/50mV=7.6V/V 으로 구해졌다.
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