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형 소자들로만 이루어진 회로로 저항의 변화가 없을 때 전압과 전류가 서로 비례 하는 회로를 말한다. 테브난 정리의 경우 원래의 회로를 전압원과 합성저항으로 간단하게 등가회로 를 구성하는데 회로가 선형회로이어야 원래 회로의 합성저
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A와 B 사이에 나타나는 저항이므로
가 되어, 그림 2d와 같은 테브난 등가회로가 구성된다. 아울러 부하 저항에 흐르는 전류와 걸리는 전압은 식(3)으로 주어진다.
그림 3 두 개의 전원을 갖는 회로
2. 예비보고서
(1) 그림 4의 회로에 대해 테브난
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1. 실험목적
-테브난 등가회로를 손으로 계산해보고 그 결과를 실습을 통해 확인한다.
2. 이론
3. 실험준비물
- power supply, bread board, multimeter, 저항, 전선, 리드봉
4. 실험 방법
1. 빵판(Bread Board)에 <그림 1>과 같은 회로를 구성한다. (실험 시 5k
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테브난 등가회로 실험
(1) PSpice 모의실험
(2) 실험 도구 및 장비
(3) 실습 및 결과
(4) 분석 및 고찰
Ⅲ. 노턴 등가회로 실험
(1) PSpice 모의실험
(2) 실험 도구 및 장비
(3) 실습 및 결과
(4) 분석 및 고찰
Ⅳ. 최대 전력 전달 이론 실
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등가임피던스 와 등가 전류원 을 이용하여 (d)와 같은 노턴의 등가회로를 얻는다.
이 회로를 이용하여 부하저항 에서의 전압 과 전류 을 구해보면
으로 되며, 이로부터 테브난의 등가회로와 마찬가지로 노턴의 등가회로를 이용하면 원래 회로
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