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->High로 되는 순간 D의 값만 Q에 나타나고, 그 이외에 어떤 D의 변화에도 출력 Q는 변함이 없다.
즉, latch는 입력이 들어오면 바로 출력을 보여주는 비동기식 회로다.
flip-flop은 회로를 보면 알 수 있지만 Cp=1 일 때는 latch와 같은 동작을 하지만
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회로에 기억된 과거의 값에 관계되는 회로회로 내부에 과거의 값을 기억하는 소자가 있어야 한다.예 : TV 리모콘의 up/down 버튼 1-1 아날로그와 디지털
1-2 Bit, Byte, Word
1-3 스위칭 회로
1-4 게이트(Gate)
1-5 플립플롭
1-6 집적회로(IC;Inte
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회로를 별도로 꺼내 기록하고 다시 회로를 집적해야한다.
(3) static RAM과 Dynamic RAM의 차이를 설명하라.
SRAM은 DRAM에 비해 집적도는 낮으나 접근 시간이 짧아 주기억 장치로 사용된다. 정적 램(SRAM)의 기본 셀은 플립플롭으로 구성되어 있어 구조
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회로도 및 결과
실험 1) Encoder 74LS148의 동작 이해
※ 실험 1 회로도 ※
※ 실험 1 초깃값 ※
※ 실험1 초깃값 이유
- 실험1의 회로도에서 초깃값은 스위치가 모두 열려 있는 상태로, 최대값인 4가 뜬다.
※ 실험 1 FND 출력 : 0 ※ ※ 실험 1 FND 출력 : 1
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플립플롭으로 부르며, 주로 분주기, 계산기, 계수기억회로, 2진 계수회로등에 많이 사용된다.
SRAM
④ 제어용 발진회로 - 일반적인 전기기기에서 필요하지 않은 구간에도 계속 동작 중인 경우에 발생하는 전력소비를 줄이는 방법으로 사용된다.
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1. 2개의 D플립플롭으로 구성된 순서논리회로의 입력방정식이 다음과 같을 때 상태표, 상태도, 논리회로도를 작성하시오(단, X, Y는 입력이고 Z는 출력이다.) ※교재 6장(주관식문제 3번-교재 p254)
※교재 7장(주관식문제 6번-교재 p299)
※교
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서 그래서 저희는 D 플립플롭을 이용하여 카운터 제어회로를 만들어 봤으며 성공적을 만들어졌습니다.
그리고 교수님이 회로를 보여드리고 교수님이 추가질문이 있으셨는데 그거에 대해서 설명드리겠습니다. 우선은
교수님이 말씀을 하신거
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기계적
움직임에 시연 가능성이 있을 것으로 생각되어 작품구상에 들어가게 되었다. 제작동기
사용부품및 공구
사용IC Data Sheet
작품의 동작
회로도 구성
작품의 구성(브레드보드)
작품의 구성(만능기판)
작품구성완료 후 동작모습
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플립-플롭에 관한 관찰 내용
-CLK파형에 HIGH 입력이 들어 올 때마다 Q 출력
<평가 및 복습문제>
1. 그림 15-3의 되튐에 의한 영향 제거 회로가 DT스위치에 대해서만 사용되는 이유는?
- S-R래치 때문이다. 되튐 현상을 제거 할 수 있는데, 정상적
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플립-플롭(flip-flop)은 7474이다. 이번 실험에서는 이 IC도 테스트해 볼 것이다.
실험 전에 오실로스코프 타이밍을 검토해 보는 것이 필요하다. 아날로그 2-채널 오실로스코프를 사용할 경우 올바른 타이밍 관계를 보기 위해서는 비교되는 두 가지
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