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의 시간 설정.
정상상태만 관심이 있고, probe용 data file의 크기를 줄일 때 사용.
- Step-Ceiling : 회로방정식을 수치해석 적으로 해석할 때 PSpice가 취하는 최대 step size -> 일반적으로 비워둠.
- Detailed Bias Pt. : enable되었을 때, out file에 상세한 bias po
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의 오차 : 파워 서플라이의 공급 전압의 오차 및 저항의 오차)가 거의 발생하지 않아 회로의 분석에서 키르히호프의 전압/전류 법칙과 전압/분배 법칙은 유용한 방법임을 직접 확인하였다.
이번 실험은 그 동안 브레이드보드의 사용법과 파워
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의 파형은 잘려서 나왔다.
세 번째 가산기 회로는 V2의 신호는 V1과 신호의 크기는 같고 위상은 반전됨으로 V0의 파형은 이 두 파형의 합인 0인 신호가 결과로 나왔다.
아직까지 브레드보드 읽는법, Pspice 사용법이 익숙치 않아 실험하는데 많은
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의 종류와 커패시터값 판독법 168
D 인덕터의 종류와 인덕터값 판독법 176
E 변압기의 종류와 사용법 181
F 직류-전력 공급기 사용법 187
G 멀티미터 사용법 192
H 오실로스코프 사용법 202
I 함수 발생기 사용법 215
J PSPICE 사용법
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의심스러워 교수님께도 여쭈어보았다. 결과 값도 잘나왔고 실험도 빨리 끝나서 매우 기분 좋은 실험이었다. PSpice사용법을 몰라 선배에게 부탁하여 그래프를 그렸는데 다음엔 직접 그려볼 수 있도록 하여야겠다. 8.1목적
8.2 해설
8.3 예비
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