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가산기)
4)http://blog.naver.com/tjrnsoehd21?Redirect=Log&logNo=50006917230(반가산기)
5)http://princess.kongju.ac.kr/ (공주대학교 디지털 가상실험실)
6)http://princess.kongju.ac.kr/DigitalMain/dvlec/textbook/chap06/digital06_frame.htm
(가산기, 감산기에 대한 전반적 이론과 소자들의
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가산기인 7483 IC과 7486 IC을 함께 사용해서 감산기와 가산기를 구하는 회로
예측 : SUB입력이 0일 때와 1일 때가 달라진다. 0일 때는 가산기, 1일 때는 감산기다. 입력 A4,A3,A2,A1과 B4,B3,B2,B1을 입력하면 가산기일 때는(SUB가 0일 때) 2진수를 더해준다.
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1. 목표
2. 이론
1)반가산기
2)전가산기
3)이진병렬가산기
4)반감산기
5)전감산기
6)가감산기
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가산기를 구현한 후에 m 신호에 따라서 가산기 또는 감산기로 동작할 수 있도록 간단한 연산을 더하여 4비트 가 감산기를 구현하였으며 위의 파형과 예측하였던 결과 값이 동일하여 정상적으로 작동하고 있음을 알 수 있다.
느낀점
전가산기
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가산기 , 반가산기, 감산기, 디코더 , 카운터
가산기
반가산기를 이용하여 전가산기를 구성
parallel 2bit binary adder
감산기
7486, 7400 을 이용하여 반감산기를 구성
전감산기를 구성
디코더
2단 2진 카운터
3진 카운터
10진 디코더를 갖춘 BCD
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