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stopwatch is
component hz-- 1kHz로부터 1/100초 주파수를 생성
port(clk, nclr : in std_logic;
hz100 : out std_logic);
end component;
component key
port(start_stop : in std_logic;
clk, nclr : in std_logic;
enp : out std_logic);
end component;
component timecontrol
port(clk, nclr : in std_logic;
enp : i
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Stop watch 기능.
- 설계 -
1. Digital Watch State Diagram
-그림-
2. Key Setting
1) KEY[0] = Reset
2) KEY[1] = Watch Sec, Min, Hour Set Mode Key
3) KEY[2] = Alarm Min, Hour Set Mode Key
3) KEY[3] = Alarm and Watch Value Setting Key
4) SW[0] = Alarm Permission Switch
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프로그램의 flow chart
▶디지털시계 작동 결과물
~별도 첨부 <타이머/카운터를 이용한 디지털시계 설계>
▶이론 및 배경
▶타겟 보드(ATmega128 보드)설명 및 회로도 첨부
▶프로그램 소스파일 분석
▶전체 프로그램의 flow chart
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. 1. 설계 배경 및 목표
2. 설계 내용과 방법
- 디지털 시계의 구성
- 디지털 시계의 동작
- DOT MATRIX 제어
- GRAPHIC LCD 및 TEXT LCD 제어
- A/D CONVERTER 제어
- Timer Interrupt 제어
3. 설계 결과
- 프로그램 소스 분석
4. 결론
- 프로젝트 후기
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24h, 12h로 변경되도록 프로그램을 수정하시오.
문제 2. 시계를 Stop Watch 로 이용하려 한다. 이때 4개의 7-세그먼트 중 왼쪽 2개는 분을 나타내고 오른쪽 2개는 초를 나타내도록 프로그램을 수정하고 동작을 확인하시오.
※ 결과 및 토의
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