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증폭기의 성능을 좋게 하기 위해서는 우선 증폭기에 인가된 바이어스를 DC분석할 때에 VCEQ와 ICQ값을 구할 수 있게 되고 이 값이 VCE(off)와 IC(sat)의 중앙에 위치하여야만 신호가 들어오지 않은 준비상태에서 동작점이 중앙에 위치할 수 있게 되
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전자회로실험
REPORT
학 과 :
학 번 :
이 름 :
전자회로실험 REPORT
제 목
JFET 공통 소스 증폭기
1. 목적
JFET 공통 소스 증폭기를 구성하여 증폭기의 특성 및 동작 원리를 실험을 통하여 이해한다.
2. 관련 이론
(1) 바이어스회로
JFET 증폭회로의 동작
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증폭기)
Vi1, Vo1,
Schematic(비반전 증폭기)
Vi2, Vo2
Schematic(단위 이득 플로어)
Vi3, Vo3
Schematic(가산 증폭기)
Vi4, Vo4
Reference
[Fundamentals of Microelectronics]
B.Razavi 저 | John Wiley 2nd Edition
[전자회로실험]
이현규, 김영석 저 | 충북대학교출판부
[FLOYD 기초회로
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of Microelectronics]
B.Razavi 저 | John Wiley 2nd Edition
[전자회로실험]
이현규, 김영석 저 | 충북대학교출판부
[FLOYD 기초회로실험 제9판 - 원리와 응용]
David M. Buchla 저 | 도서출판 ITC
[전기 전자 통신공학도를 위한 기초회로실험]
강경인 저ㅣ문은당
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증폭기를 설계 하였는데 이것은 우선 첫 단에는 에미터 저항, 커패시터가 있는 공통 에미터를 설계하였고 다음단에는 부하저항이 있는 공통 콜렉터를 설계하였다. 이것을 통하여 다단 증폭기를 만들었는데 첫 단의 공통 에미터 회로는 위에
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실험 도우미, 명정초등학교, 1999
충청남도교육청 / 효 교육 길잡이,2001
충청남도교육청 / ICT길라잡이, 충청남도교육청, 2001
한국산업인력공단 / 기초전자전기, 서울특별시 인쇄정보산업협동조합, 2001
한홍렬 외 / 생활예절과 국제매너, 서울 :
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of Microelectronics]
B.Razavi 저 | John Wiley 2nd Edition
[전자회로실험]
이현규, 김영석 저 | 충북대학교출판부
[위키피디아 지식백과]
http://en.wikipedia.org/wiki/Op_amp
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15-3
출 력
Vin
Vout
위상편이
이득(측정값)
이득(기대값)
%오차
OA
0.5vpp
0.495
180°
0.99
0.993
-0.3%
OB
0.5vpp
0.495
0°
0.99
0.993
-0.3%
▶동일한부하에 대해서 서로 180°의 위상차를 갖지만 두동일한 출력신호를 발생한다. ○ 실험 목적
○ 회로도
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기초반도체공학
일렉트로닉스 : MALVINO, 대영사
김태중 : 일반전자공학실험, 상학당
이성호·최창규 역 : 전자회로실험, Pearson International Edition 5th ed
조세황(1996) : 최신 전자 회로, 진영사
Greg Parker, 김종성 역 : 기초 반도체 소자, 대웅출판사
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McGrow Hill
안영화 외3명, 전자공학으로의 초대
홍순관 외2명, PSpice와 함께 하는 기초 전자전기공학실험, 홍릉 출판사
이석목, 2003년 1학기 전자물리 강의 노트
기초 전자 회로 실험 실험 제목
실험 목적
실험 이론
실험 방법
회로도
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