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지정된 VT+와 VT-에서만 state를 변화시킨다. ; VT+와 VT-사이에서의 입력 신호는 locked out이다.
.SChmitt-trigger gate는 아날로그 input waveform을 square 디지털 output waveform으 로 전환한다. 1.UNIT OBJECTIVE
2.UNIT FUNDAMENTALS
3.NEW TERMS AND WORDS
4.DISCUSSION
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디지털논리 회로 실습 레포트
1) 4비트 전가산기를 이용하여 8비트 전가산기를 설계하시오. 8비트 전가산기를 이용하여
입력데이터 11010001과 00001100을 가산한 결과를 기술 하시오.
2) 다음 식의 논리 회로를 그리고 파형을 구하시오. 부울 대수
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요소
보드
회로의 기반
납
단자들을 간 연결
전선
전류가 통하도록 연결
전지 (1개)
12V 전원
330옴 저항 (6개)
세그먼트에 Vcc 연결 시 전류 양 조절
0.33/0.1uF 캐패시터 (각 1개)
12V 전압->5V 전압 변경 시 필요한 요소
(2) 사용 부품
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74125 IC 핀 배치도를 참조하여 4개의 게이트 중 1개를 선정하여 그림의 3상태 버퍼(tri-state buffer) 회로를 구성한다. 74125의 7번 핀은 접지하고, 14번 핀은 +5V의 전압을 인가한다. 1번 핀은 인에이블(enable) 단자다. 2번 핀에 입력신호를 넣고 3번 핀에
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논리회로로 나타내어라.
④ 논리 게이트를 이용하여 회로를 구성하고 입력을 진리표와 같이 변화시키면서 출력 F의 상태를 확인하여라.
회로
결과
검토 4비트의 BCD 입력 중에서 그 수가 짝수일 때, 출력이 1이 되는 회로를 설계하여라.
w
x
y
z
F
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를 참조하여 그림과 같은 디코더 회로를 구성한다. 입력의 상태를 표와 같이 변화시키면서 출력 상태를 기록하여라. 여기서 인에이블 단자인 4번, 5번 핀은 접지하고, 6번 핀은 +5V의 전압을 인가한다.
C
B
A
Y7
Y6
Y5
Y4
Y3
Y2
Y1
Y0
0
0
0
0
0
0
0
0
0
0
1
0
0
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반가산기 : 2진수 덧셈에서 두 개의 비트 A와 B를 더한 합 S와 자리올림(carry) C0를 출력하는 조합회로이다.
전가산기 : 두 개의 비트 A, B와 밑자리로부터의 자리올림 C1을 더한 합 S와 윗자리로의 자리올림 C0를 출력하는 조합회로이다. 가산
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상태를 기록하여라.
E'
S1
S0
D0
D1
D2
D3
Y
1
X
X
X
X
X
X
0
0
0
0
0
X
X
X
0
0
0
0
1
X
X
X
1
0
0
1
X
0
X
X
0
0
0
1
X
1
X
X
1
0
1
0
X
X
0
X
0
0
1
0
X
X
1
X
1
0
1
1
X
X
X
0
0
0
1
1
X
X
X
1
1
회로
결과
시뮬레이션
74138과 7404 IC 핀 배치도를 참조하여 그림과 같은 디멀티플렉서 회로를
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다.
.XNOR 회로의 output은 equality의 input상태에서 high이다.
.XOR와 XNOR gate의 output은 동일한 XOR와 XNOR input state에 대해서 반대이다.
Exercise 3-2 Dynamic Response of XOR/XNOR Gate
square wave input에서 XOR와 XNOR gate의 반응을 설명하라.
DISCUSSION
.two-input XOR또는 XNOR ga
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에 놓이면 Q와 Q-not은 high이다.
.SET와 RESET 입력에 low가 걸리면 RS flip-flop회로에서는 보수의 출력을 유발 하는 것을 금지한다.
EXERCISE 5-2 D-Type Flip-Flop
EXERCISE OBJECTIVE
D-type flip-flop의 특징을 밝힌다.
DISCUSSION
.대표적인 D-type flip-flop기호는 다음과 같
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