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PRENTICE HALL Robert L.Boylestad Louis Nashelsky Ⅰ목적
(1) JFET 증폭기의 바이어스 회로를 고찰한다.
(2) FET 소오스 접지 증폭기의 특성을 조사한다.
(3) FET 드레인 접지 증폭기의 특성을 실험한다.
Ⅱ이론
(1)바이어스 회로
(2) 접지방식에 따른
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전자회로실험 P.69~83
데이터 시트 검색엔진 https://www.alldatasheet.co.kr/ 1. 실험 목표
2. 관련이론
2-1 기초 이론
2-2 소개
2-3 소자(부품) 소개
3. PSpice 시뮬레이션
3-1 시뮬레이션 준비물
3-2 시뮬레이션 과정
3-3 시뮬레이션 결과
4. 실험
4
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정류회로를 Spice로 구성하고 입력 주기함수가 8V, 60Hz에 대해 DC 출력 전압을 구하시오. 예상한 결과를 얻는지 검토하시오.
=>
시뮬레이션의 결과 로,
약 1.1V의 오차가 발생하였다. 1. 실험 목적
2. 이론
3. 실험기기 및 부품
4. 예비실험
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실험 결과 53
실험 6. 차동증폭기 55
1. 실험 목적 55
2. 기초이론 55
3. 실험기자재 및 부품 62
4. 실험방법 및 순서 62
5. Simulation 65
6. 실험 결과 67
실험 7. Op-Amp 기본 회로 69
1. 실험 목적 69
2. 기초이론 69
3. 예비 보고서 74
4.
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실험결과 ……………………………………… 23
실험 3. FET특성 및 증폭기 ……………………………………… 28
1. 실험 목적 ……………………………………… 28
2. 기초이론 ……………………………………… 28
3. 예비 보고서 …………
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