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위상을 고정시킬 수 있게 될 것이다.
4. 실험에 필요한 이론과 측정 예상 값
(1) 위상 제어 루프(Phase Locked Loop:PLL)
무선 혹은 유선 상으로 신호를 보내면 신호경로에 따라 신호 지연이 발생하고 따라서 위상이 변하기 때문에, 수신측에서 시작과
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위상 제어 루프 회로를 구성하여 주파수 동기화(Phase Locking) 원리를 이해한다.
2. 설계실습 계획서
7-3-1 위상제어루프의 용도
이론부의 위상제어루프를 이해하여 요약, 설명하고 실제 사용되는 분야에 대해서 서술한다.
▶ PLL은 세가지
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점차적으로 증가시켜서 증폭기의 Gain값을 올려줌으로서 출력파형의 크기를 키웠을 때, 왜곡이 사라지는 지를 확인해 보아야 한다. 1. 목적
2. 실험 준비물
3. 설계실습 계획서
4. 실험에 필요한 이론과 측정 예상 값
5. 결론
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개념이 현실적으로 다가오게 되어서 더욱 의미가 있었던 것 같다. 예비레포트에서 예상했던 대로 깔끔한 결과를 얻어낼 수 있어서 만족스럽다.
조교님 이번 실습도 늦은 시간까지 고생 많으셨습니다. 1. 설계실습 내용 및 결과
2. 결론
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이론적으로는 4.95kΩ을 연결해야 하지만 실험여건상 4.8kΩ로 연결했으므로 이론적으로 Vab에는 8.89V, Vbc에는 6.11V가 걸리게 된다.
≪ 그 림 ≫ 3장 예비 레포트…………………………………6p
Ⅰ. 배경 이론
Ⅱ. 설계 실습 계획
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